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像是自己在設計電路
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! n* |9 b* b2 k+ B; u4 n然後趕在CIC下限前 [* l: a- e) e! X5 m
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拼命的LAYOUT' W3 c! v3 G4 Y, X0 L3 ~/ p
0 H% U0 E9 ?# U4 y9 D8 J) D有時候,老師說要改規格
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或是其他人說你的LAYOUT要考量一堆要件時
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那時候真的很吐血啊∼!∼!
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像我個人就覺得LAYOUT真的相當的累人" _- d, l t* F+ c* |- a6 E
3 B ~5 Z& C5 h' R- ~0 d尤其是再跑LVS的時候
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除錯debug真的是要人命啊∼!! |
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