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各位好# D0 g' E# p9 t7 ~) e6 }$ B% \4 w
之前在板上提的問題，用前輩們的方法，加一個FIFO可行
- {' f, x6 U9 J 可是現在有一個小問題 Z I# n5 ?3 E6 I- g
如果本來的VHDL code，其memory controller是對SRAM做動作4 A( K3 X" H9 y, |
可惜的是，我的板子上只有SDRAM. v; h) y1 `" m4 K
根據我上網查的一些資料，他們的一些操作機制及結構腳位不同
3 r6 K& ^0 F$ S8 g2 ]3 ~ 所以，我勢必去更改裡面的memory controller的存取機制- S1 A( H6 E, ]3 O5 s
1 u3 n ]( K( S3 a- J4 t; F+ X0 n 請問，要更改這樣的VHDL code有什麼要注意的( v& K ~3 ~5 f- D' R A
code內SRAM controller上面的腳位如下：$ v* ?& y6 e3 Y+ [" s
( t6 @6 e* [: e( [ I+ Q- b. d ram_a = address bus* x& j3 p. h& W+ t# K
ram_d = data bus) N/ d6 ~7 Z7 K' {
ram_ncs = chip select0 C1 R+ `! E& R' q5 L8 Q5 a
ram_noe = out enable+ Q) O' a( p: n& m' p9 W d9 f
rama_nlb = low bank
4 B8 R8 K8 h ~! d' u rama_nub = upper bank
5 B; b0 s. C9 U! J) e, e4 K6 A rama_nwe = write enable
' T" G: g- X) d7 X; w4 l! i9 }2 Z% g+ a8 E
哪些是SDRAM上不一樣的腳位 (照我找來的資料，SDRAM動作好像比較複雜). z: l" P$ U$ ^) B8 ]6 A+ K
+ n+ j" x6 e, x2 V2 z
還有，我在網路上要打什麼關鍵字比較能找到較多的相關參考資料，或是有人release這方面的code可以參考2 _4 e( p; a: K: N( C: C
m% @0 a5 n, u9 S4 f, \3 F) H[ 本帖最後由 kyopc 於 2007-5-24 12:07 AM 編輯 ] |
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發表於 2007-5-24 00:04:11
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發表於 2007-5-24 00:34:23