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Chip123 科技應用創新平台»論壇 › Chip1 -- 基礎元件 › FPGA/CPLD/ASIC討論區 › 請問xc2v4000+(FPGA)
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[問題求助] 請問xc2v4000+(FPGA)

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1#
發表於 2007-5-20 18:14:33 | 只看該作者 回帖獎勵 |倒序瀏覽 |閱讀模式
請問燒錄到FPGA和FLASH有什麼要注意的分別嗎?都是用同一個bit檔嗎?" w- `3 B1 J1 G
/ c; l' s" D0 G/ f/ w# h
還有就是說如果flash內已經有之前的燒錄檔了,納現再我要在灌一個新的怎麼辦?他會直接覆蓋過去嗎?

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2#
發表於 2007-5-20 18:32:36 | 只看該作者
FPGA直接燒錄的話如果重開機, 就要再燒一次 5 d. O4 T5 Y! Z) F; U
如果是燒到flash的話 每次開機就會從flash讀到fpga
% R. r. F/ ^% T/ N2 `8 WFPGA就不用重燒啦4 H) h( |# b2 c$ W/ K5 a
2 z! I* Z) v4 f% ?9 u0 u- \
燒到flash 和FPGA的電路檔相同 ,但是要燒到flash必須先燒一個flash 載入的控制電路到FPGA- C$ ]! ~5 d' M: _  \
  @5 d6 K( }/ v
燒到flash的電路檔 只要位址沒有重複應該不會被蓋掉" [9 X6 }# s7 [6 l+ @% \5 m' p: ^
4 e# I# u+ q9 M6 O
[ 本帖最後由 masonchung 於 2007-5-20 06:36 PM 編輯 ]

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3#
 樓主| 發表於 2007-5-20 19:32:20 | 只看該作者
你說燒到flash必須先燒一個flash的載入的控制電路?
% M  m" l' w) c那我要去哪邊取得阿?: D. k% ]8 i% Y, Q; d# Y! u
+ D( F0 b1 q# A" ?4 A2 s
我ㄉ型號是xc2v6000(4000+)
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4#
發表於 2007-5-20 19:56:35 | 只看該作者
這跟你版子上 Flash的型號有關係
: |, j3 w6 u0 _3 Y5 P+ @9 A3 F! }: f: I
一般有個default 檔 : LM_flash_load.bit

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5#
 樓主| 發表於 2007-5-20 20:28:45 | 只看該作者
不好意思,請問可以幫我找那個所謂的default檔ㄇ?我怎麼也找不到0 \- s, A0 v! N+ h8 c5 q* S
/ o* m/ k. O; G2 P8 f
而且要燒到flash,brd檔我也不知道該怎麼寫ㄟ,我只會燒到fpga的,直接指定燒錄檔位置
  k% W+ R. k; w- q
! z! ^* m% K3 R. t3 {[General]
( E: ?' T7 m# s+ ?1 ?9 f8 L* dName = register AHB XC2V6000 -> fpga
2 n/ O1 h2 y. J5 m8 OPriority = 1
  J0 G& O7 C! u, ]0 S- w. x6 f! d" V8 b) Y8 [
[ScanChain]
1 V8 Q( g" m! I5 ]- I: s) ITAPs = 2
+ ~, A( b3 x/ K% S3 C1 C$ CTAP0 = XC2V6000
6 C* s5 G, P$ f: ~& e0 }* V. qTAP1 = XC9572XL
% ~, t  ^8 d1 d( }, g
* R7 s# R0 X8 V  h  ]/ I: b  H[Program]# Y# _; l6 ?9 m1 V
SequenceLength =12 j' D8 g% `. d( c. k! H/ Q' f7 l
Step1Method    = Virtex2
- y5 h: {3 @; k8 Z0 CStep1TAP       = 0
- {7 D+ r( v, f3 T0 E) kStep1File      =register1.bit
& Z6 L6 M5 V" m5 s4 l% L% p% g  t0 Z8 C: w1 x6 E$ J# k4 K
那請問燒到flash要怎麼加怎麼改?

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6#
發表於 2007-5-20 21:12:55 | 只看該作者

回復 #5 happpyend 的帖子

對於FPGA跟flash燒錄方式解釋." ~. b0 H" L: x
燒FPGA時,是Bit file,而大家把FPGA想像成RAM,燒完就工作,但電關掉,資料都不見了,所以重開機就要再燒一次,
: d  x" z; m  c' Q. A+ ], j要把FPGA拿來量產,那就必須搭配一顆flash或ROM,
& _  G$ }. c* Q3 J: Q$ M而燒flash時,是mcs檔,原理就是一開機,硬體會去偵測download方式,然後自動download到FPGA,也就是說,每次重開機,
9 s$ h3 A9 K- a* z: j- H硬體會把flash裡的設計線路,自動download到FPGA去執行,所以設計時只要注意download的模式(ex:spi flash模式,BPI flash模式,串列模式....等).
4 N  d7 y3 i. W& V: E5 V3 B所以一般開發時,都只燒FPGA來驗證function,量產就只燒flash^__^

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7#
發表於 2007-5-20 21:23:02 | 只看該作者
假設 flash 之 memory mapping 在 0x200000* t9 S, c: b' r9 L+ r% e. z
至於LM_flash_load.bit 請你找找 .brd 檔範例 有兩個以上SequenceLength的,用他的Step1 File
9 Z$ T7 P/ O# gltxc2v4000_102c_xc2v6000_via_build1.bit ==> 這個應該是6 M3 \: L2 G& N9 k8 ]- a, R8 z

1 B4 Y, W5 s( o  N/ T, S; U7 R- @' Z[General]
5 e4 R) E' L9 M  Q. k5 JName =  Download to flash (Addrress 0x200000)
7 c, I* `% j" Y' m: L; ZPriority = 1* m3 H% A; G  d/ y  q! W, G

; e, _$ ?3 X, N3 B6 Z7 }[ScanChain]
: h, `/ i3 J+ L; F3 Q. ?TAPs = 2
" K" P8 z8 q5 {1 u" |2 W: A% ~% u* ATAP0 = XC2V6000* j9 Z; {# r% f2 P( K
TAP1 = XC9572XL
% u* [" W. I' _% K' l
, P4 J0 t4 ]  h, o[Program]# |0 N8 P. }1 V3 v2 M
SequenceLength =3% V' V: w0 n6 X6 p& n: `6 [8 ~  {
Step1Method    = Virtex2" r5 O; k7 i7 _! R
Step1TAP       = 0
1 o. N. l8 K3 S" u4 F7 k5 r% [Step1File      = ../LM_flash_load.bit
3 L9 o+ A6 q) z: EStep2Method    = IntelFlash; a$ E  X3 _, i3 M% `, x* v" h/ M
Step2TAP       = 0x200000' e3 k1 ?& \1 X
Step2File      = register1.bit! F* b9 Z  b7 O6 [: `
Step3Method    = IntelFlashVerify7 o8 Q( R' T9 I0 [+ F# h
Step3TAP       = 0x200000
# b" Q2 h& t% z  AStep3File      = register1.bit
7 [7 e# U, T: r' m/ w3 `! N% x  z/ B8 C( y# m- l0 p* [
[ 本帖最後由 masonchung 於 2007-5-20 09:28 PM 編輯 ]

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8#
 樓主| 發表於 2007-5-20 21:39:59 | 只看該作者
ㄜ...不小心選到poor...不好意思...0 ^; o( x5 i2 @7 n7 _* O2 h! t

& `9 |4 \: Q0 o你剛剛說的方法我在試試看....
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9#
 樓主| 發表於 2007-5-20 21:48:17 | 只看該作者
我試了還是不行ㄟ...錯誤訊息在附件中
) V1 ]9 I0 ^+ {. f6 l
# u! @- \4 t. X$ b' x& l& X- q還是我哪邊還有沒設定之類的ㄇ?

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10#
發表於 2007-5-20 21:57:13 | 只看該作者
應該是 flash 的 Memory mapping 不對
( R8 N6 h$ Z2 U# T6 `$ f
& L% Y# [0 v1 h" c: s$ L1 R你這種設定是! S& T2 T% V* o: G
FPGA ==> 0x000000
* F0 m, _' O" [& N8 M% @& Y+ y6 tFlash  ==> 0x400000
1 Q; l# K/ C, u" O1 b) R6 r4 N; l! V/ m, F
Check 一下你的 Memory mapping 設定檔...
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11#
 樓主| 發表於 2007-5-20 22:10:31 | 只看該作者
SequenceLength = 3# n# c  z* |+ e
Step1Method    = Virtex2
3 h7 |  S3 Y. [3 p+ DStep1TAP       = 0
. ^0 J+ _8 n$ a! [+ |Step1File      = ltxc2v4000_102cd_xc2v6000_via_build1.bit  (清空flash的檔案?)
0 X  M' m; d% T% z, g7 ?Step2Method    = INTELFLASH  (??)
# L# |( v( l/ UStep2TAP       = 0x400000    (這邊是要填誰的位置阿?flash?fpga?)/ q( p7 U8 S# X8 Q. Y
Step2File      = register1.bit   (怎麼跟下面的重複?燒兩次?)
0 A/ s: x0 f# b" AStep3Method    = IntelFlashVerify  (??)1 r- [+ q/ A+ u
Step3TAP       = 0x400000   (這邊是要填誰的位置阿?flash?fpga?)2 O$ o* i5 T* V- Q
Step3File      = register1.bit) q: f/ K/ K* I1 @% P! p* n

" G( y2 a8 i  g. Q, o/ y( i* W這幾行是什麼意思阿?
6 E  z- p2 }' W& P4 O! q3 X+ O  w" D5 D$ y7 I
我的附檔是memory mappingㄇ?

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12#
發表於 2007-5-20 23:05:32 | 只看該作者
[General]
: {/ I" {  c+ z" uName =  Download to flash (Addrress 0x400000)
( K  h2 D! I% @- |7 J' g& QPriority = 1/ q. ?  i  g. C

+ }2 m% O$ K) p* U7 A& K[ScanChain]; E1 J5 k4 k7 K* P
TAPs = 2
, j1 t8 {/ V, }) ]. T$ v+ n. rTAP0 = XC2V60000 l- ~, P& S- G& ?0 F& c7 m3 G! p3 q: ~
TAP1 = XC9572XL
9 M( ]  o  O* U0 m4 e! q8 t; L* a9 Z9 G1 Z) h
[Program]! a7 u! _& Q/ p1 A; Y+ ?
SequenceLength =3* K. i+ ~4 j$ J# H: m' `
Step1Method    = Virtex2$ U, k; H; v8 q# j1 B% u- j
Step1TAP       = 0              3 k) s: u- y+ }4 y' N
Step1File      = ../LM_flash_load.bit <==控制Flash開機後載入電路到FPGA (Logic Module)
  I& H+ m' t6 R! X, mStep2Method    = IntelFlash <== 只是Flash廠牌代號  ~  D! X$ _3 e$ h
Step2TAP       = 0x400000  <== Flash位置
( T- m: s" P& r8 {8 y$ T5 L3 RStep2File      = register1.bit$ v2 C8 t+ H5 S, g# V4 b) z
Step3Method    = IntelFlashVerify <== 檢查電路有無燒好用& A1 ]- n5 M1 D0 W
Step3TAP       = 0x400000 <== Flash位置4 \; \3 a* z3 d6 x! ]/ Z3 X
Step3File      = register1.bit6 L0 u( i) M3 M+ z: L* L+ t
, E/ I" H5 m: h
看來你要改S2成第二種設定 [1] OFF  [2] ON; ^' j5 A6 H! M" p/ V
# K- T1 d/ ]: i3 f/ \' M' h" g
[ 本帖最後由 masonchung 於 2007-5-20 11:12 PM 編輯 ]
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13#
 樓主| 發表於 2007-5-20 23:17:07 | 只看該作者

回復 #12 masonchung 的帖子

一樣顯示% W# F) z+ I; t! H9 y
error in board description file<step device/TAP>
- ?1 y  \) O5 f7 {$ m4 K& k2 i3 Y. o, V  b* R
.....難道是flash廠牌代號打錯??* j' v1 c7 T2 V- s2 v

3 Q0 T8 ], U+ R4 p. Y還是燒錄flash的時候,有哪些特別要注意要設定或要條jumper的
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14#
發表於 2007-5-20 23:59:28 | 只看該作者
我記得有個Memory Mapping 的設定檔 和你的版子有關係
- J) c- C0 w& b' [1 O) u9 S9 }但是一時想不起來啥名稱 好像是.arm 還是啥的...
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15#
 樓主| 發表於 2007-5-21 00:21:04 | 只看該作者
請看依下附檔9 x& p/ X3 z) c
, T: c$ d: b+ ]9 A& V4 x
為什麼我按照LAB的流程2 B, A- G$ X$ u2 w9 c) _

8 J: x  g/ |; F" u6 M' e9 i& T他把brd檔分開寫成兩組
5 \$ l7 S  k2 ^! O$ d. U, F1 T1 U( T2 \3 j) `( ^' }" M1 E
一組寫入FPGA
5 v2 \( H% _4 z" ~5 H
0 b' [; z" ?$ v: y: W一組寫入FLASH
( }/ `& E7 R' g0 p" c, e' }. m' ~# v+ i+ J' |
然後先燒入一再燒錄二,而且他也沒有定義address的位子ㄟ; P, N7 z4 H# |* L

4 O9 s7 c# i6 @5 t) b請問這樣真的也可以嗎?布過我想應該可以八,他都已經編成講義了(2003年的很久之前的)

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16#
 樓主| 發表於 2007-5-21 01:24:30 | 只看該作者
請問附檔說的是什麼意思1 ~0 i4 m. G6 u7 ?0 P8 d, D; H, u! n; |
+ I, P9 o: v7 }" {7 R3 }" j
就是要燒錄到fpga一定要設定成jtag嗎?那cclk又是幹麻的?為什麼為起始設定4 e- f. [8 \& p* f
2 |  p3 p, W; I; f. W
用cclk就沒辦法燒錄了嗎?

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17#
 樓主| 發表於 2007-5-21 01:30:25 | 只看該作者
剛剛連結錯檔案...這個才是對的..0 v+ O1 s( r8 P+ y+ B; [4 ~0 p& g
/ a0 g) T! e& l7 D4 ~, F
希望大大可以給我解答5 Z( v0 E2 @1 z3 `: J

( @2 b* s8 y# D. i% k感謝賜教

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18#
發表於 2007-5-22 10:29:10 | 只看該作者
你說講義的日期是2003年...& A' Y" D& @- N7 f
編著者是誰啊???能說一下嗎?
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19#
 樓主| 發表於 2007-5-22 12:26:10 | 只看該作者

回復 #18 tommywgt 的帖子

http://access.ee.ntu.edu.tw/course/SOC_LAB/index.html, @2 ~+ X" u' l9 n
) C1 k. Y8 Z. d% d; t) j* a) \
這邊有連結~~你就可以看的到了
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20#
發表於 2007-5-22 14:18:43 | 只看該作者
......
) |' o" s6 f' d哈...哈...我笑了
- q) w  d6 e( G5 R+ v9 r6 G, S6 b主啊, 請原諒我
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