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Chip123 科技應用創新平台»論壇 › Chip1 -- 基礎元件 › FPGA/CPLD/ASIC討論區 › 請問xc2v4000+(FPGA)
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[問題求助] 請問xc2v4000+(FPGA)

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1#
發表於 2007-5-20 18:14:33 | 只看該作者 回帖獎勵 |倒序瀏覽 |閱讀模式
請問燒錄到FPGA和FLASH有什麼要注意的分別嗎?都是用同一個bit檔嗎?' i" p$ G- t2 Y# f( Z
; g" l) w+ C0 z0 c7 N. X' G
還有就是說如果flash內已經有之前的燒錄檔了,納現再我要在灌一個新的怎麼辦?他會直接覆蓋過去嗎?

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2#
發表於 2007-5-20 18:32:36 | 只看該作者
FPGA直接燒錄的話如果重開機, 就要再燒一次
9 f7 h3 z8 v4 E3 {6 D如果是燒到flash的話 每次開機就會從flash讀到fpga % s5 @) b, C  u8 g$ e5 f' x
FPGA就不用重燒啦; l7 v- J& d+ Z: m3 O
% q- v9 z  C. |4 ^
燒到flash 和FPGA的電路檔相同 ,但是要燒到flash必須先燒一個flash 載入的控制電路到FPGA( i4 V1 b7 k3 i- P( N

7 h! K" s/ p1 |燒到flash的電路檔 只要位址沒有重複應該不會被蓋掉
4 ?- Z- U  ~* {+ `4 J9 g5 y' O4 F0 z0 R* K4 f2 w
[ 本帖最後由 masonchung 於 2007-5-20 06:36 PM 編輯 ]

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3#
 樓主| 發表於 2007-5-20 19:32:20 | 只看該作者
你說燒到flash必須先燒一個flash的載入的控制電路?
3 v" i$ q# u4 _$ H% t那我要去哪邊取得阿?
9 \# ~" b; s# V' x( H* n6 k- i4 _$ G  z* c1 G0 o4 l
我ㄉ型號是xc2v6000(4000+)
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4#
發表於 2007-5-20 19:56:35 | 只看該作者
這跟你版子上 Flash的型號有關係9 [9 |+ a. n) l3 U7 T( `

+ ?" @% k+ K1 N* d8 b( ^一般有個default 檔 : LM_flash_load.bit

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5#
 樓主| 發表於 2007-5-20 20:28:45 | 只看該作者
不好意思,請問可以幫我找那個所謂的default檔ㄇ?我怎麼也找不到
, h+ a, n, L2 o- {# ^: y* t* r( z  v8 u2 V7 j
而且要燒到flash,brd檔我也不知道該怎麼寫ㄟ,我只會燒到fpga的,直接指定燒錄檔位置
6 Y: v; A% [9 W; i4 F3 B' x* c9 i
[General]& q5 s5 O7 F4 q: c/ O; R
Name = register AHB XC2V6000 -> fpga( B# z" o7 j. v# Q% G
Priority = 1+ x( y! y1 z6 W5 \1 |) h- G

8 H3 e& a$ B; I[ScanChain]
8 ^. f; r- u( \4 Y% `  Q2 ZTAPs = 29 q/ d/ @, n; ~0 I
TAP0 = XC2V6000" }) x. D! g  D( V( D
TAP1 = XC9572XL
+ A+ q8 @* V3 }3 I  F- j4 ~1 c* t3 t  Y; I) W" e
[Program]& z  ^( S9 L9 ~4 a  I1 o) O/ w
SequenceLength =1$ B6 Q2 D& w! A
Step1Method    = Virtex2# \9 r# ^0 x3 |! P; f3 k4 b
Step1TAP       = 03 I: N8 V6 b1 r) Q5 w* H
Step1File      =register1.bit& N4 C# @0 q7 S* I. N

, |# c7 v# T+ S/ B那請問燒到flash要怎麼加怎麼改?

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6#
發表於 2007-5-20 21:12:55 | 只看該作者

回復 #5 happpyend 的帖子

對於FPGA跟flash燒錄方式解釋.
- p$ X2 F/ _( ^+ ~, _# g6 t8 \燒FPGA時,是Bit file,而大家把FPGA想像成RAM,燒完就工作,但電關掉,資料都不見了,所以重開機就要再燒一次,
7 f* W7 g! R( }1 D' ]要把FPGA拿來量產,那就必須搭配一顆flash或ROM,6 \% K7 }2 K0 ^( C+ u/ [
而燒flash時,是mcs檔,原理就是一開機,硬體會去偵測download方式,然後自動download到FPGA,也就是說,每次重開機,
+ S9 @, s5 ?6 {  O1 Q硬體會把flash裡的設計線路,自動download到FPGA去執行,所以設計時只要注意download的模式(ex:spi flash模式,BPI flash模式,串列模式....等).5 t% E9 N' r. M& ]; Q
所以一般開發時,都只燒FPGA來驗證function,量產就只燒flash^__^

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7#
發表於 2007-5-20 21:23:02 | 只看該作者
假設 flash 之 memory mapping 在 0x200000
" ]7 O) P+ Q3 O0 A6 g' i  `/ z至於LM_flash_load.bit 請你找找 .brd 檔範例 有兩個以上SequenceLength的,用他的Step1 File
1 h7 J' B. T8 iltxc2v4000_102c_xc2v6000_via_build1.bit ==> 這個應該是
2 e; }, y& ?1 i# F, g9 P, Q- k  K! L! S* z" H/ @
[General]$ h/ u) Q  u( {& R
Name =  Download to flash (Addrress 0x200000)
8 s- c$ ^' f; D/ L' j0 VPriority = 11 s3 ?$ E3 a3 }2 G, U

4 C8 v0 G9 h) Z[ScanChain]7 l( E1 K$ X+ O, `3 x3 p" G
TAPs = 2
/ o+ \; o  u( E6 f+ ZTAP0 = XC2V6000' ?9 _4 L; h, Y
TAP1 = XC9572XL
4 L) t1 g* U' z9 n2 {
. V7 D+ A/ k( A[Program]7 ~! s! G: O9 S! ^" d' G
SequenceLength =3
; d+ _- f& `5 G; @( n/ bStep1Method    = Virtex2
. s( W4 p8 l" L& c* iStep1TAP       = 0
) X: ]9 c& D/ L4 a- @Step1File      = ../LM_flash_load.bit& z! O8 s3 {' W
Step2Method    = IntelFlash
6 d8 l9 z5 J9 k# S" c- u1 K) K1 _Step2TAP       = 0x2000001 [1 C+ c9 D; I) _
Step2File      = register1.bit
& q* ?3 S- i5 x4 f/ {Step3Method    = IntelFlashVerify
, V3 e1 L( y8 S, ]: C& JStep3TAP       = 0x200000
# U  X1 O, o6 }' ^Step3File      = register1.bit' i# ~3 W2 Y" f% K) u, u
* p" ?$ P( v, X! x; N9 Y" H2 Q
[ 本帖最後由 masonchung 於 2007-5-20 09:28 PM 編輯 ]

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8#
 樓主| 發表於 2007-5-20 21:39:59 | 只看該作者
ㄜ...不小心選到poor...不好意思...
; Y1 l7 N( q; L1 c/ _7 \% F/ r9 _# W# q0 j3 V' [
你剛剛說的方法我在試試看....
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9#
 樓主| 發表於 2007-5-20 21:48:17 | 只看該作者
我試了還是不行ㄟ...錯誤訊息在附件中
& l/ W. K. v5 y) ~! x+ d9 d; w/ a- _# W
還是我哪邊還有沒設定之類的ㄇ?

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10#
發表於 2007-5-20 21:57:13 | 只看該作者
應該是 flash 的 Memory mapping 不對
4 K3 @( {/ I. L# @$ I
+ |4 `9 \& z* {你這種設定是
; S+ F4 n, W; xFPGA ==> 0x000000
' V( Z' J: S& k" k( F4 HFlash  ==> 0x400000
6 q9 a3 E1 n* t& G. ?# h& ]3 |& ~& \5 G6 F' U3 a
Check 一下你的 Memory mapping 設定檔...
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11#
 樓主| 發表於 2007-5-20 22:10:31 | 只看該作者
SequenceLength = 3
& E# S; j1 [$ O- W; O: d- m- O8 o$ tStep1Method    = Virtex21 i& A( _+ Q5 C
Step1TAP       = 09 ]  N; {2 U* F2 b: p
Step1File      = ltxc2v4000_102cd_xc2v6000_via_build1.bit  (清空flash的檔案?)
; J7 L6 Z6 A) L- H# f) A5 aStep2Method    = INTELFLASH  (??)0 Q& O% G5 O% S7 Y
Step2TAP       = 0x400000    (這邊是要填誰的位置阿?flash?fpga?)
' _/ m% w( i4 K5 R4 jStep2File      = register1.bit   (怎麼跟下面的重複?燒兩次?)  u0 Z* M. {7 L& K
Step3Method    = IntelFlashVerify  (??)
4 V: I9 ?& ]. ^# L+ T# ~  U, w( LStep3TAP       = 0x400000   (這邊是要填誰的位置阿?flash?fpga?)
+ A" E; a; z6 Y% \; V) Y& OStep3File      = register1.bit
- ^% ?1 \  H" T+ U: R/ s% {4 @3 t+ T* g' X3 Y. E2 t2 H
這幾行是什麼意思阿?+ l/ G& `3 a+ b( I

: P; f1 J# O. h# D# E我的附檔是memory mappingㄇ?

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12#
發表於 2007-5-20 23:05:32 | 只看該作者
[General]3 y0 [0 W9 y1 \; \: v: ~
Name =  Download to flash (Addrress 0x400000)5 B% U4 x9 _8 u+ M
Priority = 1
4 x1 I1 }1 v' H$ ]5 a( I5 o3 }" r' Z/ k, a
[ScanChain]. O8 W0 c$ G- A
TAPs = 2
# ~0 e2 k  G9 j: I& ?, ]! ITAP0 = XC2V6000
. Z" [5 ~1 q. w4 K) b. RTAP1 = XC9572XL
1 Z& ~3 `% \5 R* L1 Z
" G0 v: }* x. R; E1 ~[Program]
3 R7 ?) L( @3 e7 A: SSequenceLength =30 z/ p' I) y! {/ {( u0 g
Step1Method    = Virtex2# K6 u; E( |/ ^  @0 O* z
Step1TAP       = 0              
9 q4 W! K! D0 @- m8 S! F4 |Step1File      = ../LM_flash_load.bit <==控制Flash開機後載入電路到FPGA (Logic Module)
5 p; j; g. j& [; l( N; q# zStep2Method    = IntelFlash <== 只是Flash廠牌代號
2 K- }. r+ q  C9 e) {2 p. ~4 }: vStep2TAP       = 0x400000  <== Flash位置
! ]( o% P7 o3 DStep2File      = register1.bit+ x& Y6 ~4 i" t; f& k+ b
Step3Method    = IntelFlashVerify <== 檢查電路有無燒好用8 m( v9 @. E6 B, \# k7 }4 T
Step3TAP       = 0x400000 <== Flash位置) W2 j% A  M+ v, y
Step3File      = register1.bit
7 Y3 f6 u4 o  }/ O5 s: b0 P. W5 D5 _- t" G7 l6 x
看來你要改S2成第二種設定 [1] OFF  [2] ON( g, f' R& m' B& T  r/ f0 B; d8 W

2 t8 [+ }# P( y7 U. s# X9 n[ 本帖最後由 masonchung 於 2007-5-20 11:12 PM 編輯 ]
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13#
 樓主| 發表於 2007-5-20 23:17:07 | 只看該作者

回復 #12 masonchung 的帖子

一樣顯示6 t% S* \- V* Y. e
error in board description file<step device/TAP>" B4 x4 k& o  d$ T3 c. x5 f) q

" q. n/ D$ \/ x& k) o" W.....難道是flash廠牌代號打錯??* O; Q; x1 y) i% ?& z; s$ N3 l

3 y9 _; m4 ~) j' ~還是燒錄flash的時候,有哪些特別要注意要設定或要條jumper的
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14#
發表於 2007-5-20 23:59:28 | 只看該作者
我記得有個Memory Mapping 的設定檔 和你的版子有關係! W8 z2 K! q0 U* v
但是一時想不起來啥名稱 好像是.arm 還是啥的...
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15#
 樓主| 發表於 2007-5-21 00:21:04 | 只看該作者
請看依下附檔, s: W  g2 i+ v7 p

/ {6 t3 |# X  F+ ?$ p$ X1 w為什麼我按照LAB的流程
3 i8 L2 n  V& e- l+ Z- o& _
* N1 d# l1 b' m2 Z他把brd檔分開寫成兩組
" Q8 q5 i4 q/ P& F4 m, x9 @4 V; p6 Q' x- i) N0 _
一組寫入FPGA( t2 u2 z4 R( g7 _% R. f+ j
; r1 c7 k, x$ E$ Y
一組寫入FLASH2 i5 P; Z5 N$ P
, _. d# Y  t5 z
然後先燒入一再燒錄二,而且他也沒有定義address的位子ㄟ" b4 I; v% v3 s$ B2 w5 A
; \5 ?- S5 M& S: ^
請問這樣真的也可以嗎?布過我想應該可以八,他都已經編成講義了(2003年的很久之前的)

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16#
 樓主| 發表於 2007-5-21 01:24:30 | 只看該作者
請問附檔說的是什麼意思
" H0 v: x* i+ e  W, _" r/ a
* g6 @' V' ?" L! u就是要燒錄到fpga一定要設定成jtag嗎?那cclk又是幹麻的?為什麼為起始設定+ s8 @. e9 u: Z* w8 G* W! b

# K; o5 t1 |+ H# F; k' g用cclk就沒辦法燒錄了嗎?

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17#
 樓主| 發表於 2007-5-21 01:30:25 | 只看該作者
剛剛連結錯檔案...這個才是對的..9 ~; F6 j- \& p
9 e2 c$ d$ s' L- D. D
希望大大可以給我解答3 w' U$ ^3 y' D2 Y

; a1 x' j2 I+ l4 v  _' {感謝賜教

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18#
發表於 2007-5-22 10:29:10 | 只看該作者
你說講義的日期是2003年...# c8 D, l5 A. g. @  ^4 q
編著者是誰啊???能說一下嗎?
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19#
 樓主| 發表於 2007-5-22 12:26:10 | 只看該作者

回復 #18 tommywgt 的帖子

http://access.ee.ntu.edu.tw/course/SOC_LAB/index.html& z3 P  P4 w5 q3 r: O
+ E6 }) |; i6 N6 q
這邊有連結~~你就可以看的到了
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20#
發表於 2007-5-22 14:18:43 | 只看該作者
......2 v3 G$ i$ B# b
哈...哈...我笑了1 z: f5 K* l+ u& }% N; E* C
主啊, 請原諒我
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