PLD,CPLD,FPGA 的區別？

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感謝這位老手的說明，不過還有沒有更好的區別方式？:o
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/ _0 {$ D: k- ?' ?3 l帝國老手：
7 ~* w8 ^& g  ], R3 X6 I" g/ Y8 r不同廠家的叫法不盡相同，PLD(Programmable Logic Device)是可編程邏輯器件的總稱，早期多EEPROM工藝，基於乘積項（Product Term）結構。

8 M& T" L4 I: T" X6 Q不同廠家的叫法不盡相同，PLD(Programmable Logic Device)是可編程邏輯器件的總稱，早期多EEPROM工藝，基於乘積項（Product Term）結構。
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7 @) r7 K/ H5 g5 c5 T& z( ?FPGA (Field Programmable Gate Arry)是指現場可編程閘陣列，最早由Xilinx公司發明。多為SRAM 工藝,基於查找表（Look Up Table）結構，要外掛配置用的EPROM。
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) S. K* T0 n6 P( Z0 x4 C" [% DXilinx把SRAM工藝,要外掛配置用的EPROM的PLD叫FPGA,把Flash工藝（類似EEPROM工藝）,乘積項結構的PLD叫CPLD;
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$ z5 h" Y& q+ W* }Altera把自己的PLD產品:MAX系列（EEPROM工藝）,FLEX/ACEX/APEX系列（SRAM工藝）都叫作CPLD,即複雜PLD(Complex PLD),由於FLEX/ACEX/APEX系列也是SRAM工藝,要外掛配置用的EPROM,用法和Xilinx的FPGA一樣，所以很多人把Altera的FELX/ACEX/APEX系列產品也叫做FPGA。

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系統的比較，與大家共用：
儘管ＦＰＧＡ和ＣＰＬＤ都是可編程ＡＳＩＣ器件,有很多共同特點,但由於ＣＰＬＤ和ＦＰＧＡ結構上的差異,具有各自的特點:

①ＣＰＬＤ更適合完成各種演算法和組合邏輯,ＦＰ ＧＡ更適合於完成時序邏輯。換句話說,ＦＰＧＡ更適合於觸發器豐富的結構,而ＣＰＬＤ更適合於觸發器有限而乘積項豐富的結構。

②ＣＰＬＤ的連續式佈線結構決定了它的時序延遲是均勻的和可預測的,而ＦＰＧＡ的分段式佈線結構決定了其延遲的不可預測性。
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5 X  j3 R& l& x: U8 e, i③在編程上ＦＰＧＡ比ＣＰＬＤ具有更大的靈活性。ＣＰＬＤ通過修改具有固定內連電路的邏輯功能來編程,ＦＰＧＡ主要通過改變內部連線的佈線來編程;ＦＰ ＧＡ可在邏輯門下編程,而ＣＰＬＤ是在邏輯塊下編程。

④ＦＰＧＡ的集成度比ＣＰＬＤ高,具有更複雜的佈線結構和邏輯實現。

& e' J$ [# y3 ~4 O) K⑤ＣＰＬＤ比ＦＰＧＡ使用起來更方便。ＣＰＬＤ的編程採用Ｅ2ＰＲＯＭ或ＦＡＳＴＦＬＡＳＨ技術,無需外部記憶體晶片,使用簡單。而ＦＰＧＡ的編程資訊需存放在外部記憶體上,使用方法複雜。

4 @" u1 L: |) m6 K" W! k- f" o7 n+ f⑥ＣＰＬＤ的速度比ＦＰＧＡ快,並且具有較大的時間可預測性。這是由於ＦＰＧＡ是門級編程,並且ＣＬＢ之間採用分散式互聯,而ＣＰＬＤ是邏輯塊級編程,並且其邏輯塊之間的互聯是集總式的。

⑦在編程方式上,ＣＰＬＤ主要是基於Ｅ2ＰＲＯＭ或ＦＬＡＳＨ記憶體編程,編程次數可達1萬次,優點是系統斷電時編程資訊也不丟失。ＣＰＬＤ又可分為在編程器上編程和在系統編程兩類。ＦＰＧＡ大部分是基於ＳＲＡＭ編程,編程資訊在系統斷電時丟失,每次上電時,需從器件外部將編程資料重新寫入ＳＲＡＭ中。其優點是可以編程任意次,可在工作中快速編程,從而實現板級和系統級的動態配置。

* M, Q, w# @& Y; E⑧ＣＰＬＤ保密性好,ＦＰＧＡ保密性差。

⑨一般情況下,ＣＰＬＤ的功耗要比ＦＰＧＡ大,且集成度越高越明顯。
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ＣＰＬＤ的功耗要比ＦＰＧＡ小吧,

/ I6 C2 E! v7 G! M! YFPGA的資源豐富

' Z; q1 `. J+ T) ?. M# \cpld是熔絲結構的，fpga是基於ram結構的。
& F% D. b! Z. Q. }7 u9 x8 @- hcpld比fpga生產成本高
2 u8 c( n' o/ R9 P複雜的信號處理通常是fpga來做