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[經驗交流] 工具使人变懒,使人变笨

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發表於 2008-7-18 14:46:15 | 只看該作者 回帖獎勵 |倒序瀏覽 |閱讀模式
工具使人变懒,使人变笨  2008-6-26 17:24:007 u: W# D% L! r/ R

. w; R1 Z. ^/ x3 b8 c工具使人变懒,我想大家都有体会,最典型的比如洗衣机使人不会再想着手洗衣服、电脑、手机的输入法已经使我们看到汉字熟悉,却写不出来……人变懒后就不会多动脑,就有可能变笨。5 r0 I; j7 H3 o+ r5 G  A1 r

/ ~) ]( h- E/ }& h" b1 {& r, o9 cIC业界的EDA Tool有同样的功效,作数字电路的写code,越来越宏观,好像现在可以直接用C语言写电路,设计者已经不需要关心逻辑门的工作原理了;作模拟电路的,直接调用PDK,省去了不少原先需要设计者自己设定的参数;版图设计的自动化也是越来越强,现在说全定制版图都可以类似于PR了……$ ?# S5 W( L9 }
5 t) e! W4 ?. E  T1 j0 N% D
Tool的功能越来越强,肯定是对我们的设计带来更多帮助,有利于提高设计的质量和效率,但是,也不可小瞧它的副作用。# B& f; Q& b( ]5 O5 H0 y" ~

2 y- ~. a+ p7 w0 t3 r, B举例来说,我碰到不少的面试者,问他们CMOS电路中作bandgap电路里的PNP管的结构,回答是不知道,设计时直接调用了PDK,至于它到底是什么样子,没研究过。但我觉得模拟设计者,连所用器件的结构是什么样子的都不知道,是很难把电路设计得很好的...
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2#
發表於 2008-7-27 09:08:06 | 只看該作者
ANALOG CAD 短期內還起不來吧' a( i  Q) H! a/ p" Q
畫數位電路的LAYOUT工程師的確是可以退休了 但類比的還可以活很久: ~5 @( u8 L: l5 ^
其次 很多工具  你還是得了解他的演算法 還有準確度. _- n+ R* z& k# h' `5 m+ ]! U+ s
先了解他  才能夠使用它 使用得很好
3#
發表於 2011-10-8 14:46:02 | 只看該作者
当要设计的电路规模足够大之后,设计者所关注的必然需要更加高层次,这是为了设计效率而做的tradeoff
4#
發表於 2012-4-19 16:01:49 | 只看該作者
怎ㄇ可能~~你找的人應該是digital layout 吧!!!3 C( y: m: R5 }- s
有畫過analog layout~~ 基本上bandgap ,OP,都有應該會有畫過才對
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發表於 2013-12-16 21:52:56 | 只看該作者
这是出产品与精品的区别,没有底层积累,估计做不出精品,但是这种拿来主义不妨碍出产品。
6#
發表於 2014-3-14 10:18:52 | 只看該作者
的確是這樣  工具好用就可以加快開發速度
' }7 [- o, `) u+ Y5 j" |- A但是漸漸的 工程師就會不知道原理...有發生問題就沒能力找問題
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