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Chip123 科技應用創新平台»論壇 › Chip1 -- 基礎元件 › FPGA/CPLD/ASIC討論區 › 模块的P&R问题求教
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[問題求助] 模块的P&R问题求教

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eel
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1#
發表於 2008-5-16 09:55:05 | 只看該作者 回帖獎勵 |倒序瀏覽 |閱讀模式
我想问一下,在P&R的时候,能不能不加IO PIN,; \/ m/ k6 A0 `

  z% f: q3 X( d3 G$ R0 W& }% n因为我想做模块的版图,不是整个芯片,所以不用外部的IP PAD,  在Astro中可以不加IO吗?. w: b* X- e- g) m) z7 `
& K  ]$ g; x6 D8 @4 K
具体怎么操作, 有谁知道吗?
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2#
發表於 2008-5-18 01:10:36 | 只看該作者
在astro當然可以不用加IO pad
) w$ U' D; P( d( D3 F5 Z& q我在module p&r simulation或hard core時都這麼做
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