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為什麼MOS上的SOURCE要接到BULK

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1#
發表於 2008-3-30 18:28:39 | 只看該作者 回帖獎勵 |倒序瀏覽 |閱讀模式
BULK與SOURCE端相接的原因除了避免LATCH-UP,另一個就是
" S  `2 o9 g: |# g. s7 j& C避免BODY EFFECT 也就是基底效應,如果你有讀過VLSI的書不難: h; @* f6 s; @$ U2 ?( c* N: q4 U, t' t
了解SOURCE跟DRAIN的導通必須透過"空乏區",空乏區的產生必
8 m  n0 f) u+ Y" y  _5 q須透過從GATE端輸入的電壓,當輸入的電壓大於臨界電壓時空乏區, j- T+ |+ O4 `1 j+ B' [% V. V
才會產生,臨界電壓與SOURCE端的電壓有密切的關係,如果沒記' C8 J; I+ d5 p& }( M5 h
錯GATE電壓+SOURCE電壓等於臨界電壓,如果SOURCE端電壓. |' S  C$ A2 Q$ W: T& i
不等於0,將會造成打開空乏區的電壓必定需要增大,相對這種情況1 q$ j+ T+ Q& O5 r6 m  r! J
下的MOS就不易被導通,而且增加了電壓上的損耗。
/ I* c- R# i, a3 W8 u  s$ ]* z: H" Y3 o+ C1 b6 e
如果有寫錯還請各位指正,謝謝。
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2#
發表於 2008-3-30 19:15:40 | 只看該作者
以 PMOS 而言, Body 可接到 S 或 VDD. : r" V( n8 P8 ~8 v+ w
都是為了保持 Body 對 Channel 的逆偏。
3#
發表於 2008-3-30 19:31:01 | 只看該作者

回復 1# 的帖子

應該是Vgs>Vt也就是說Vg-Vs>Vt........................................
4#
發表於 2008-4-1 00:18:14 | 只看該作者
Seems it depends on application, Vt vary with Vsb. Mostly if we want to have min. Vt, source is connected to bulk.
5#
發表於 2008-4-1 07:29:14 | 只看該作者
讀了一遍  覺得文中所稱的  空乏區  應該是 反轉區吧  (Inversion Layer)
- S1 Y2 C$ i9 L5 o2 R我的認知是覺得  Body effect  就是 VBS=0   NMOS就是 source與bulk 要接到 GND
* I7 Z0 ^8 ?9 o& A6 b3 CPMOS 就是 source與bulk要接到 VDD# i* u: ^  h: l# b; B; ~  W: P
但是電路上還是會有 VBS不等於0的情況' C9 }% A2 Z$ `) s' `
這通常發生在  MOS串接的情況   不管是 Cascode還是 CMOS邏輯 串聯的那一塊
$ _3 o; @, P1 M9 g6 V7 L( K' n, G都無可避免的有 基底效應出現,  所以一般來說 我們做 CMOS互補邏輯  最多就是用到 4-Input " w$ m6 s& L; e% Q' Y2 f# e' r. o
因為太多輸入時   串聯的MOS間會有  Chrge sharing的問題, 其次就是疊越高的MOS Body effect會越嚴重
: O/ H3 C$ L; w2 t/ a- r" d最後一個Issue是   該邏輯拉到 1或0 其中一邊的速度會變成非常慢.% R* Z# b( H+ P  @6 y6 S% e
Cascode最多就是疊兩個   疊太多會傷到  OP ICMR 或 Output swing.
5 |1 r, l/ _! h- M' x$ B
. {- @7 k8 E% e( @, j1 `[ 本帖最後由 yhchang 於 2008-4-1 07:30 AM 編輯 ]
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