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為什麼MOS上的SOURCE要接到BULK

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1#
發表於 2008-3-30 18:28:39 | 只看該作者 回帖獎勵 |倒序瀏覽 |閱讀模式
BULK與SOURCE端相接的原因除了避免LATCH-UP,另一個就是
' e; c- c+ l2 ~2 T# _" ^避免BODY EFFECT 也就是基底效應,如果你有讀過VLSI的書不難# ~8 c! O$ d% H/ d' ]# [
了解SOURCE跟DRAIN的導通必須透過"空乏區",空乏區的產生必
8 c! U: m( [, _2 Y# Z9 O& M6 P$ x須透過從GATE端輸入的電壓,當輸入的電壓大於臨界電壓時空乏區0 w3 b: z  W0 t# f& a; q6 b* x
才會產生,臨界電壓與SOURCE端的電壓有密切的關係,如果沒記2 @4 m0 M4 ~; `' T& Y9 A/ G/ Q
錯GATE電壓+SOURCE電壓等於臨界電壓,如果SOURCE端電壓
7 v8 b  M& n  |$ h' k6 y/ j不等於0,將會造成打開空乏區的電壓必定需要增大,相對這種情況+ G0 u8 R3 V% F% K; g3 \' p
下的MOS就不易被導通,而且增加了電壓上的損耗。
1 e8 D" F* |4 w/ z- x( ?; R+ t; {% m$ @1 b9 d/ n' y5 n
如果有寫錯還請各位指正,謝謝。
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2#
發表於 2008-3-30 19:15:40 | 只看該作者
以 PMOS 而言, Body 可接到 S 或 VDD.
8 l# K( D  l( o  Q7 X7 r6 s都是為了保持 Body 對 Channel 的逆偏。
3#
發表於 2008-3-30 19:31:01 | 只看該作者

回復 1# 的帖子

應該是Vgs>Vt也就是說Vg-Vs>Vt........................................
4#
發表於 2008-4-1 00:18:14 | 只看該作者
Seems it depends on application, Vt vary with Vsb. Mostly if we want to have min. Vt, source is connected to bulk.
5#
發表於 2008-4-1 07:29:14 | 只看該作者
讀了一遍  覺得文中所稱的  空乏區  應該是 反轉區吧  (Inversion Layer)% w$ X' R9 p3 G9 ~
我的認知是覺得  Body effect  就是 VBS=0   NMOS就是 source與bulk 要接到 GND3 F. c3 y$ p7 d, x) A- |
PMOS 就是 source與bulk要接到 VDD
" E0 H. @2 o1 d) _# H但是電路上還是會有 VBS不等於0的情況
& Y& w& v! [" k1 F! R2 \% @0 S這通常發生在  MOS串接的情況   不管是 Cascode還是 CMOS邏輯 串聯的那一塊) f2 U' U3 h, H0 b# q" P2 E+ e
都無可避免的有 基底效應出現,  所以一般來說 我們做 CMOS互補邏輯  最多就是用到 4-Input
  z9 |5 z; B8 G& Q! j$ V7 x/ E因為太多輸入時   串聯的MOS間會有  Chrge sharing的問題, 其次就是疊越高的MOS Body effect會越嚴重
4 S- k  [- I" {6 s( r最後一個Issue是   該邏輯拉到 1或0 其中一邊的速度會變成非常慢./ ~/ g: ?8 K8 i* h" ^; U+ @
Cascode最多就是疊兩個   疊太多會傷到  OP ICMR 或 Output swing.
; c/ d+ c7 u; w% p, O! K& i6 q7 ~9 X# Y* j
[ 本帖最後由 yhchang 於 2008-4-1 07:30 AM 編輯 ]
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