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[問題求助] FPGA外接DAC電路??

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1#
發表於 2008-3-6 17:44:52 | 只看該作者 回帖獎勵 |倒序瀏覽 |閱讀模式
我想請問一下~ 其實是一個dac小問題
, \. y  x, _) a1 R# x" T7 P( h8 Cdac輸入部分有區分成serial和parallel 那連接fpga 若我送一8 bits的訊號 速度假設是8MHz& z+ c# N& m: B  i
那serial型的DAC輸出速度不就剩1MHz3 w; q6 V# Z" F6 l2 |; a
(我是把他想成說是一個一個bit排序接收完8個~再判讀輸出)
) S" t1 t9 D6 Q0 Z* Z: y/ p而parallel型輸出仍可以8MHz
: a8 \3 R/ C. J, `1 G我的理解對嗎??* x6 r( S( ?. |  z
有人可以分享一下如何挑一顆適合的DAC嗎??感謝
  W& `' \1 }0 k4 S' \* Z對了~還有spec上會寫多少channel是什麼意思呢??感謝
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2#
發表於 2008-3-7 10:00:39 | 只看該作者
挑DAC?6 c4 H9 I6 h& \3 h0 H
1. 輸出的dynamic range
( H# ]' C. f  `3 l2. output resolution* v# y2 V& M* L- C' H
3. bandwidth! {2 _8 y* }$ l" C3 Z/ w$ |
4. 線性度
$ [5 f* B8 `& ]" I1 R0 Q6 G5. power supply0 Q6 L3 \0 G+ p$ D" I3 Z
6. interface (serial / parallel)$ `/ q5 D3 h- G+ I& r& Y, J6 t
以上幾項都滿足project需求的, 就挑到了0 H  O* S6 K7 g, `' C
1 J6 o4 A3 y  O9 f7 J8 M
channel?" h2 p& O7 ~3 d& s. `
一個package中包含了幾棵DAC, 大概可以這樣看) Y1 U- B; B& r& U. Q! R2 p! m

7 @1 q. Q7 N4 L' O1 e% M* p: t提供一個問題, 假設DAC是 12bit, interface是8 bit, 則interface跑
) q( Q  Q% n, X3 D0 v1 d1 Mbit, 那最少要2 byte才能update DAC的輸出, 再加上一些有的沒的/ m. I! D: E) p: f+ s, X5 A
所以頻寬部份怎樣看, 還是要仔細k datasheet才知道
3#
發表於 2008-3-11 11:51:23 | 只看該作者
基本上, serial DAC只是為了省管腳, 速度上自然不會太快' F# D  {. n5 M2 O+ {" w4 h
實做上, 要先訂出你要的規格再來選, 答案很快就有了.
4#
 樓主| 發表於 2008-3-29 23:54:16 | 只看該作者
版主~您所謂的定需求是指~??: x3 @8 q  e9 w: s) v9 h
: c4 K/ B8 m5 `8 ^3 g
我的話就是DAC輸出能越快越好(用於光學實驗)# {+ s1 E5 l' ]# Z6 J9 F: G
=================================================+ Q" ]9 Y  h$ r6 W, ]0 S2 f  D2 ]
不好意思~
  J" I" d* Y! r. X3 E2 ]. [; v5 P$ D# x& m* u* D0 Y: D4 D9 m
我想請問幾個問題
$ F: R, f  f' i/ _! l
, b1 N: m  S, I/ j* Q像Xilinx FPGA 6 f! V. @; B7 J. m3 F1 Z/ e
( http://0rz.tw/193QX )7 C! a9 M+ y; _* z/ Y
+ z8 |# T9 \7 f" h7 b7 J5 {& l, ~2 F- r
i/o有提到
. ]4 j- O8 f, Z, O; b2 b1 t9 @# V. @1 Q+ Z
分成selectI/O和differentialI/O5 }6 M1 S. G8 V6 K* _7 K7 p4 X
. M: p' M9 w! i/ R) V  e
是說~/ m; [! f2 C. O/ Z

" i3 u% |0 r+ M% k  b# X因為我現在要用FPGA外接一顆DAC作光學實驗6 p2 Y  i4 C$ ^3 A  K

" D& O/ X7 o, r; T若我選用的DAC傳送介面是LVDS或是RSDS這類~
" r" P8 y" a# r* Q3 H5 N# U( M* c! l) ^4 R4 i
那fpga它速度上就要看differential i/o這一項嗎??
8 m9 t, N+ u: V3 v5 U# h8 T2 _: |9 k: h& `1 [' x2 @: c
因為高速的DAC介面大多是LVDS1 U/ p1 M+ N7 q  x
- L2 x: F  E7 ~; r0 X; |
==============================================( B3 G8 R8 S* x+ D6 X5 ~
, }0 Y; a/ x9 g  a! a5 [
像這一顆(AD9734); @+ n* o' e: E0 `5 {% }! Y" K
http://www.analog.com/en/prod/0,,AD9734,00.html% P/ I' {* A4 N( ^
  \4 N( Z+ f. b/ N/ h! J- [
他介面寫說用LVDS
. L  F0 d2 R7 a7 R7 d/ h/ \: J) i+ X' r! j
但又寫著
0 ]+ z" v4 y' a* I& X" _) lDouble data rate (DDR) LVDS data receivers support
: I6 R! C) e- V! k. Wthemaximum conversion rate of 1200 MSPS.. `& f1 g; ?) N: {
+ u! t$ q  F7 ~9 ?4 X0 I
我搞不太清楚  = =?% J/ `2 J$ ~8 r

( x  F$ ]# l7 h+ n' R==============================================
5#
發表於 2008-3-30 17:13:49 | 只看該作者
簡單的說...2 l/ u0 x7 ~8 W/ ^; H1 ^

$ R- d  v( S) {1 K1 K你需要Virtext-5的FPGA (可以傳1.2G LVDS)去配合AD9734- N/ {6 |8 ?9 x6 y# w
# N. g9 h. H0 N+ z6 M
好巧...二顆我們公司都有賣
6#
發表於 2008-11-24 15:37:47 | 只看該作者
I had trouble to control AD9734  from FPGA. Do you have some examples ?
, |2 o6 j7 j9 J( |+ F, q2 v. }+ w; d" g+ I; I
Thanks
7#
發表於 2008-12-15 16:32:12 | 只看該作者
有電路圖嗎?0 Y, }6 k, Q% @! N+ u! r
至少先看過FPGA跟AD9734的電路才好討論
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