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[問題求助] MOS DUMMY大小

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1#
發表於 2020-10-26 10:48:13 | 只看該作者 回帖獎勵 |倒序瀏覽 |閱讀模式
最近遇到問題是當matching完為了防止蝕刻8 o- [6 d/ b, F# C4 }+ B# Y7 K
所以要補上DUMMY但是DUMMY的大小要怎麼去設計呢
) B' F- O! k8 M9 N! o9 `/ s! ?有人可以跟我解釋一下嗎? 謝謝各位~~ " n9 i1 p; C# K1 P$ n; V1 |

6 u; T* j& T4 Z( d
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2#
發表於 2020-10-28 01:20:27 | 只看該作者
可能還要考慮 WPE/LOD 之類的不過如果真的要無腦放 然後也是偏類比的6 ]& b5 R; _" s, c! r
你就把旁邊 主要的mos 放兩個W/L 一樣的在旁邊吧
. Y# s& ~; ?+ m4 `
3#
發表於 2020-10-28 10:03:15 | 只看該作者
補充,Stress spacing 也是考量之一,/ A# r' y* C" h' ]7 ]
* l2 Z' k( H, O
至於說要怎麼設計?# M" h! Y. x' G- E

0 q; M8 V3 u& D1 ]5 f; I通常layout的作法,會直接使用您需要加dummy的device的直接複製相同的siza 作為dummy
% y& e' C: p  B( e. |8 _: i$ H- g$ v- n* V6 X: T+ p& X
S/D 的接點就要看你的合併的訊號源作為依據去設計,G接地即可/ z& n) ]3 t; {7 Y" ^6 D+ ^4 v
/ T" J+ q4 d! n( w9 f$ p
至於dummy加的量以designer為主,至於加多少量參考經驗值作為依據,每個製程被要求的dummy距離不一,
4#
發表於 2021-6-23 18:06:25 | 只看該作者
詢問有經驗的人,或直接請你的designer跟你說0 r2 d$ l( ~& H, R) B; A; a: o
不同製程,情況都不同,所以沒有一個能解釋清楚的依據可以通吃  g5 E. {- m7 X2 r, }
但學科觀念到是可以幫助你理解原因
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