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[問題求助] CIC類比IC競賽決賽-電路除錯求救

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發表於 2020-7-16 15:46:19 | 顯示全部樓層 |閱讀模式
今年參加CIC競賽決賽遇到一些問題,想請教專家意見。1 K' ?# R* Z; \8 L6 n/ I" ?9 u
            
1 A" p7 [3 a; n% Z! C7 a這是今年決賽的電路圖,為6bit log DAC,使用0.35um製成,工作電壓3.3v。
. g" b) O& e6 L; D% I9 r4 I* Y初始時會對63C充電至2v,再利用C減少63C儲存的電荷,最後用Buffer輸出。; K/ C, {4 ?# T! X
! C  ?6 D! V/ c$ y2 B, N$ Z
  n- B! G+ p4 P1 N
              4 E6 Y- F" F% K; r* g
這是時序圖,CLKb為CLK的反相訊號。/ o1 D7 M- G7 m3 Y; `
參數規格要求DNL<0.5 LSB,在比賽時確認有達到標準,但成績公布時DNL參數卻大於0.5 LSB。7 _1 S5 R# ^$ [. k$ i: e+ v  U
以下是成績複查的結果
, H* }; j* t0 n) ^         , O- ?6 W3 n! G  i
在63個DNL數值中,前62個都正常,但為什麼在最後一點突然超標,4 m& [5 D7 ^/ s4 ~+ t& f) A4 d# ]
實在想不出哪裡出錯,拜託各位專家高手替我找出問題。
0 N; Y' t8 E& q3 ~3 S; y: _6 B

- r) _2 u: W. s; A5 N, `
8 c! v0 u8 E' g% b
8 J9 |6 Q& Y: I1 i: @1 i* g

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發表於 2020-8-6 09:46:21 | 顯示全部樓層
如果確認63C及C charge sharing的結果都符合預期
" q8 d7 h( |5 E- D, W, Z$ F% ]可以看看Output buffer的input range足夠嗎?
發表於 2022-3-2 13:34:14 | 顯示全部樓層
想請問樓主是比full custom的嗎
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