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[問題求助] 惡魔藏在細節裡

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1#
發表於 2013-3-22 12:59:08 | 只看該作者 回帖獎勵 |倒序瀏覽 |閱讀模式
各位先進好:
1 ~, p8 p6 g: b% ^  小弟在大學才開始接觸這方面的知識,可以說算是十足的Layout初學者,也許下面問的是笨問題,但請各位新進不吝指教。% ]0 v1 Y& c  y$ z1 ]
小弟只有一次下線的經驗,而且還是fail的。是在大三的時候,透過CIC下線了一科教育性的OP(TSMC.18)並以此為畢業專題。; ]8 O: {% |7 I( t# i
下線回來的晶片,每一科實測的結果都不同,而且跟模擬的結果有相當大的出入。0 J5 c) V! ?* C9 N& L
. v4 ]/ y; i& G. o
我的同組組員拿著當初我們設計的OP去面試的時候,那位主考官一看設計就直接了當的跟我同學說:「我們這設計是失敗的,對嗎?」
  F- k' q9 ]1 o2 H; w那位考官對我同學說 你們的metal I 跟 metal II 的面積不一樣,角度也不對...3 Y5 P: e$ B/ h" D# d
雖然她最後還是應徵上了工作,不過這已經是題外話了。3 L3 h$ R$ d1 s3 u7 g1 d
' V$ c* P, J+ B8 T) ^
我重新審視之後,覺得自己當初的設計確實應該好好檢討。
  B& p, [& r5 g- T& }最近我想再嘗試一次下線,所以想好好的搞清楚Layout規則,而不再像我以前一樣,抱持著只要DRC、LVS過就好的心態來完成Layout。
" D$ Z3 t" a  `( f* _4 [- v% e6 l
( ^+ I/ p2 g( ~" [; [我知道寄生的問題是很重要的關鍵,也知道Layout有許多小細節必須注意。
3 K6 w- _* y: E" r  }& |也或許他有他的淺規則,只是我還不夠清楚、或者沒注意到。(小弟應該是前者)7 a9 J0 ]# C1 y. b/ W) R

- R4 s+ B. R- N7 G  e對於這些技巧很是不熟悉、不清楚的小弟我想請各位先進提點小弟我,在畫Layout的時候有什麼是該好好注意的呢?
# D& C0 D. y3 `1 R1 s) p9 b( o/ a0 b
希望各位先進可以分享自己以前Layout失敗(或者成功)的原因,也許我接觸的還不夠多,能理解的也有限,但總希望自己能越謹慎越好!, G$ P: k( e, E  W

3 {" p+ n6 J" U謝謝各位!
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發表於 2015-6-25 00:32:55 | 只看該作者
opa確實是內部對稱比較重要,主要是因為他的輸入差動訊號對是否matching會直接影output,而且萬一這個opa的gain很大,mis-match還會被放大好幾倍。而這個是否matching主要是由opa本身layout方式決定。雖然有些rd會覺得說,訊號走線沒有對稱也沒有用,其實這是要看你這顆opa的操作頻率來決定。若是input高頻的訊號,確實連走線位置、長短、用哪層metal、一點點couple c 都非常care,若是一般幾MHz的話……還好啦,走線基本上沒有影響。但是若mos不對稱,lay不好,不管是高低頻都很傷。給你參考。

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2#
發表於 2013-3-26 07:51:23 | 只看該作者
学习了学习了学习了学习了学习了学习了
3#
發表於 2013-3-27 13:03:18 | 只看該作者
在畫Layout的時候有什麼是該好好注意的呢?
0 D0 z4 m4 J2 i5 A3 a) h
; x/ T. c- ~/ n' F* g  l3 p- }要注意的事情 太多了
4#
 樓主| 發表於 2013-4-1 18:42:52 | 只看該作者
回復 3# motofatfat
0 s2 ?0 N8 `  ]7 }
: K8 z( @% `. G% E9 ?8 F/ G& s
5 ~& }' @( Y2 z2 k/ }: h. F3 n    誠如您所說,我也相信真的有很多。
7 r) O# V) o  C8 a; y但不知道能不能明舉或是列點出來,這樣也比較言有所物。
) G) F! Y6 r* |
% P) ~+ Y& s- C* o4 ]# r% Y8 N4 G4 {' B方便的話,我們用類比最基礎的原件 - 運算放大器OPA來討論。
& c2 m: E# B: U6 K5 U如果有列舉出來的細項我看到不懂,我也能自己去找相關資料。
' o  p% G# |6 j' K& Z
- b  r; I* y. x) g# D+ M8 x就我知道而言,一個OPA的Layout對稱性相當重要。& B2 K% e8 f' W6 b3 q7 E
而在一個OPA電路中,電容電阻佔了面積相當大的部份,而且也不易做到對偁。
" Z7 f9 o4 X; t9 u7 P! F- @5 N; C2 R) l# i: e
如果可以的話,也許您可以建議我怎樣的擺設可以達到較好的對偁性?! I) b8 A' v* z. j& N+ r: c& w
而電流鏡偏壓給一級放大時,我可以考慮在差動放大的地方加上Guard ring來降低雜訊。
/ {6 l! R  u/ ~, d( [3 N" T( x6 e3 V; @  ^* |! I8 Q
諸如此類的,對於我這個初學者來說,都是相當重要且值得參考注意的。
$ T4 {, L* _/ H6 g$ `
* d( z* b; E7 T7 t( o$ a小弟不才,不知道可否請您講的詳細一些。受教了,謝謝!
5#
發表於 2013-10-6 00:20:54 | 只看該作者
對 Layout 來說 OPA 是要對稱性
4 D/ |' r! W: t但是有一次我聽到了...............) w" `& N: S+ q% b6 ~- b8 d
我的主管與RD主管的對話,讓我笑了
) F) P2 Y4 _1 t$ G7 v$ Y' W4 g4 V我的 layout 只有 MOS 對稱,走線大部份對稱
: d. q! c- B6 x: L我的主管認為不好,後來我們去找RD討論" G# Z0 k5 ]/ n6 G' Y9 q& E
一句話精典名言 " OPA內部對稱, 那外部的與 OPA 相接的走線有對稱嗎? "
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