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樓主 |
發表於 2012-9-15 12:56:57
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│ │ └─logs
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│ │ ├─crf2 `$ x" }8 g) @$ ?/ \$ ], X
│ │ ├─srpg
- N; A8 T: M) h0 d│ │ └─tbench
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│ └─tools0 v# Z. U; g' H1 }8 n
│ └─VerilogCrf
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│ ├─logical# V$ Z8 Q8 q8 P7 ~3 e
│ │ ├─cm0ikmcu. u7 E* u3 Y2 g8 A- ~
│ │ │ └─verilog7 P8 z( ^0 g8 J/ I6 r7 c# M5 ^; k
│ │ └─tbench# }4 \- K0 C; S @3 x
│ │ └─verilog2 i/ c1 s( t/ {% [
│ └─validation
2 w, m' F' s: h6 m9 J7 K│ ├─glogs* |- z. P$ k6 a' \
│ ├─logs
2 |1 Y5 z" U" m* h$ q2 b│ ├─mdk& t, P3 t6 d" w" {4 d
│ ├─srpg
9 b% i, U: U5 w+ s0 R8 o4 S│ ├─tests2 `2 \/ N# S0 w# N; J
│ │ └─CMSIS
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│ │ ├─CM0# W6 B# q3 Z/ z) O" k5 O- M
│ │ └─Documentation; h4 c0 s7 M0 E J. L: i
│ └─vectors1 P @6 R' O( I3 _0 t. C9 I
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│ │ │ └─AMBA36 p# \: H. z# E
│ │ └─arm.com/ D+ L3 s0 }6 [4 S/ z+ q$ j5 Z; @
│ │ ├─CoreSight
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│ │ └─arm.com8 F4 \0 M0 E+ r, P, _
│ │ └─Cortex-M0
9 w6 ^3 H* N- Z* B) o9 n0 k* Z│ │ └─rtl4 t4 B; I1 d- W- q8 k; [
│ └─components3 m7 N$ j; V6 H3 v z+ t
│ └─arm.com
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│ └─verilog9 n! F+ |/ L* n+ ?5 ^
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└─verilog |
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