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商周出版一本書: π型人:職場必勝成功術,,
3 B# j A. t( a, d& s& w( ]裡面提到「「π型人」的方法,讓你在最短時間內,選擇適合自己的第二專長,並與第一專長融合,發揮一加一大於二的威力,帶你安然度過景氣寒冬,成功迎接春天的到來。」
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# ]: a) b& Y" x4 j' Y, d1 q" |1 k在IC Layout世界裡, 小弟的解釋為:
- e1 P2 I0 ^# u9 \9 dIC Layout工程師,除了提升本身IC LAYOUT的技能外,(平常多閱讀國外期刊,美國佈局專利或進修等..)* Q x) [4 g: H& R& \# ]. n
另外再學習和本身工作的前、後,也就是上下游相關的知識.
* w/ U9 f8 M, C3 p7 `例如:IC設計和 晶圓製程或 CP測試
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" f: L* B8 K0 a3 a(??? 有人一定會問我,IC LAYOUT 學IC設計和測試做啥?) 1 _' u" z$ J4 A
隨著製程演進, IC Layout在舊製程不存在的問題, 在前瞻製程未必不會碰到,
6 h, C1 d9 p( R7 F& T' j# Y9 L+ b. l" ]
學習IC設計並不是要超越IC Designer,而是為了能更清楚的溝通電路設計理念,! n7 }# k8 F6 T1 p. O+ q: H- P
學習晶圓製程或CP(Wafer sort)也不是要成為製程或測試工程師,,, U V% }4 u& F' w j
而是要了解自己的佈局在台積電裡面會怎麼跑, I/O PAD的擺放對CP(Wafer Sort)測試結果有沒有影響,或是可以最佳化
+ _: s6 V" Y J+ A! {當然公司或Fab一定會有舊的Rule可以依循, 但是Rule為什麼要這麼定通常了解不深(因為太忙了..沒空想那個)
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/ H7 q* O3 W+ l' N3 c所以試著了解上下游合作的工程師在做什麼,, 辛苦一陣子,,
, e* z4 v8 {7 }0 t必然可以脫離 「像是在 做工ㄉ感覺得,, 」3 m: L; o9 j% T+ G: b
' n0 u- h7 a6 n共勉之~ |
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