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商周出版一本書: π型人:職場必勝成功術,,
; P' R7 S3 \9 Y- j y裡面提到「「π型人」的方法,讓你在最短時間內,選擇適合自己的第二專長,並與第一專長融合,發揮一加一大於二的威力,帶你安然度過景氣寒冬,成功迎接春天的到來。」
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在IC Layout世界裡, 小弟的解釋為:
8 h9 ?8 |" s9 g) @! M Q- BIC Layout工程師,除了提升本身IC LAYOUT的技能外,(平常多閱讀國外期刊,美國佈局專利或進修等..)! l" Z& G D' ~+ x8 E7 g
另外再學習和本身工作的前、後,也就是上下游相關的知識.
! p8 \- j3 p) X0 n例如:IC設計和 晶圓製程或 CP測試) Z+ j) s3 ]8 @$ K; _% T0 D. N: F
5 S9 ]$ k# B& C( D3 E- e7 O(??? 有人一定會問我,IC LAYOUT 學IC設計和測試做啥?)
' P% S% j. Q5 ?! i& X% W2 |隨著製程演進, IC Layout在舊製程不存在的問題, 在前瞻製程未必不會碰到,
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, I" y8 U1 Q* |. G學習IC設計並不是要超越IC Designer,而是為了能更清楚的溝通電路設計理念,: J4 q* a9 p8 o* ^# y: V1 x3 P
學習晶圓製程或CP(Wafer sort)也不是要成為製程或測試工程師,,) I; f4 |* I7 u+ d5 Y7 k7 B: k
而是要了解自己的佈局在台積電裡面會怎麼跑, I/O PAD的擺放對CP(Wafer Sort)測試結果有沒有影響,或是可以最佳化
- J" b% m( C" k, p" k- O6 V! s, V當然公司或Fab一定會有舊的Rule可以依循, 但是Rule為什麼要這麼定通常了解不深(因為太忙了..沒空想那個)
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所以試著了解上下游合作的工程師在做什麼,, 辛苦一陣子,,, D: I" P+ P, n1 n0 [4 l8 [
必然可以脫離 「像是在 做工ㄉ感覺得,, 」* I, R. C+ F1 l$ g& ~! }5 ]
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共勉之~ |
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