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[問題求助] 關於下線的問題

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1#
發表於 2010-5-13 17:52:30 | 只看該作者 回帖獎勵 |倒序瀏覽 |閱讀模式
近期可能要下教育性晶片,但是看到教育性申請須知與說明上頭寫了一段話
. Y8 o) G$ L( M( d: J( Z5 U: h
/ H  ^: j% N& d2 ?9 E" m/ R6. 繳交檔案及資料:' D' R4 ^; k6 [2 ]! S$ u
申請人必須於申請截止日P.M.17:00前完成下列1) 至3)項,繳交資料不全者、逾期者皆不受理。- G* r. v# b$ |, ~
1) 請ftp 技術資料:
2 I$ x4 W3 B' y7 @) P[1] 佈局檔4 j2 p& `6 H; u
[2] 佈局驗證結果檔(DRC、LVS或Apollo驗證結果檔)  m4 A8 U* `& L8 r
[3] Tapeout Review Form。0 \+ A% {/ B0 b6 f% E- F- O2 Z
註1:不可使用cell library。1 ]0 ~/ _" I' n' i1 U
註2:佈局檔案上傳完後請上傳「OK」檔,以檢查上傳佈局檔是否無誤,並至晶片上傳檢查系統網/ \7 w" r# O1 q. B8 t% |
頁: “http://www2.cic.org.tw/~shuttle/chipworks/ ”以確認申請是否成功(若網頁上無其上傳資訊者,
1 N) X7 }6 j5 O' C視同無申請)。
' C" C3 R3 X8 t; J* f
. B/ Y* N  W8 d- Z) p; j% j紅色的部分還不太懂它的意思,是說不能用tf檔裡面的cell,還是連自己畫的cell都不能叫出來用?
$ N( z4 X$ i, z% h2 h  o麻煩幫我解答....
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2#
 樓主| 發表於 2010-5-14 11:47:12 | 只看該作者
前輩可以幫忙解答嗎, ]5 [: Q" R0 I# A: N7 M

2 Y4 y  E3 s! }7 o真的很急...
3#
發表於 2010-5-14 19:05:35 | 只看該作者
是指不能用標準元件庫 (Standard Cell Library) ; w- G3 J( M. r9 ?$ A
用全客戶方式去下線就對了
4#
發表於 2010-5-14 19:28:20 | 只看該作者
意思就是所有電路 包括邏輯閘都要自己畫就是了
6 o& E5 {+ q, n) l/ K. r4 T8 M' R0 efull customs bottom up design
5#
 樓主| 發表於 2010-5-14 20:39:08 | 只看該作者
非常感謝~~~~你們的解答
1 ^8 q4 b* r# l$ `, s
1 C" S4 |" ^2 y& c% Q6 `$ V7 O; k: d那自己畫的CELL可以叫出來用嗎?
6#
發表於 2010-5-15 00:49:58 | 只看該作者
自己畫的當然可以2 l6 H% O' N, u3 Q6 L7 @
它的cell是指 CIC 或TSMC幫你做好的cell+ F  ~" p/ C8 o( f  j4 m
因為是教育性晶片...chip size跟gate counts 都不會太大
- Z6 ^3 }7 `. ]: o) V所以他希望學生全都自己動手
& e6 g& c2 ]) w. LPADs 則可以使用TSMC或工研院提供的cell
- g" H5 ]  a( Q5 O) d, o+ t只是不能違反它的命名規則  X' _% {- g$ ?2 {# L  Q
前瞻性晶片就可使用cell library 而且面積沒限制
7#
 樓主| 發表於 2010-5-15 01:48:03 | 只看該作者
回復 6# shangyi
! Z4 F3 f$ Y  }! T% [% W% O8 b- s1 H( b, _8 H) g9 ~: E
恩~我了解了~~~非常感謝前輩的指導
8#
發表於 2010-5-19 17:14:45 | 只看該作者
原來是這樣~~了解 又多學一件事
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