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[問題求助] layout到快沒信心了~

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1#
發表於 2010-1-31 23:04:04 | 只看該作者 回帖獎勵 |倒序瀏覽 |閱讀模式
最近接一個adc的案子,從去年的25日,弄到現在,都還沒弄好
" o' k6 |  L  F1 V5 T) e7 [+ E9 b6 r弄到現在光是看到layout,就很頭痛。雖然各個block都有,也都修改好了,但是當初做的人
( {- w5 y5 _( \# l+ l  H0 i( F* q卻是東拆西拆的,雖然各block有8成的完好度,但是東拆西拆的電路,卻是雜散的,找地方放。2 t6 O  Y3 A5 ?' }
弄到現在真的是越做越沒信心,心情越做越 down。更慘的是tapeout日子都快到了。" f$ _2 ?+ |1 t' K5 C5 b/ O
3 T, m) x- L( A3 ^$ v
想請問一下,如果各位前輩們,如果接手的案子中,如果是像這樣子layout的各block只有八成的完好度的話
. X  U0 @0 I8 w, `9 q你們會怎樣做?? 整個floor plan的擺放位置,跟前一個adc又不同的話,你們又會怎處理??
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2#
發表於 2010-2-1 01:41:00 | 只看該作者
1散的block 重做會比較快,不然你trace 出電路時時間就會花很久.2 }( C& k1 h1 g; R' W' X% W
2做出後再給designer PEX 去post-sim 就可以.
3#
發表於 2010-2-1 14:36:05 | 只看該作者
接別人的如果電路小我會重新Layout
$ U* T+ m. e) s$ v& n4 T如果是大電路那只好硬著頭皮做囉~~, T# l9 l4 f, c& s

6 Z/ W9 ]* _2 k, G3 H$ ?加油~~
4#
發表於 2010-2-4 14:17:49 | 只看該作者
回復 1# ynru12 / \; L7 i3 D, m0 \8 d" _/ j# ~5 n
4 o+ X) B# {' d+ B

- z5 D' M# p: Y' H7 \, A) {    Hello~我可以了解你的感受~但是請您加油支持下去~等到結束後~你的能力會更上一成的~努力會有代價的~我前年也有碰到類似的問題~那時以為自己快撐不下去了~還好我師傅有在旁邊~我們就一邊做一邊"暗"
2 M8 p1 |" f: V的做完~做完後~真的覺得有跟以前的自己不同~現在我雖然不是很厲害~但是~加油~咬著牙~撐過~加油喔~
5#
發表於 2010-2-7 14:32:44 | 只看該作者
回復 1# ynru12
7 S6 q1 J' x' {5 G7 J
  n: l. c% B5 y6 |* v9 E加油阿! 撐過去就開心了!!
6#
發表於 2010-2-8 15:15:48 | 只看該作者
一定要有耐心,总会过去的。平静的心最重要!
7#
發表於 2010-2-18 18:32:37 | 只看該作者
回復 1# ynru12
9 I% j  S4 q( o5 u3 y, O4 Z0 t, W7 l1 V  `" o- `: f$ Y
: U8 v- T- P! r& ?  d# a  M! v2 _
    佈局工作就是要具備靠自己去完成的能力和觀念,從專案規劃、floor plan、執行佈局工作、whole chip routing & verify。如果有他人幫忙也要盡可能自己完成才會有真正的體驗。& N7 G2 G3 C6 ?6 Y2 E, h2 T. L
承接案子有兩種,一種是完整專案晶片,你可以憑藉經驗和電路設計觀念去做好floor plan,再開始你的佈局。另外一種是承攬外包案,客戶會給予舊的參考檔案,也許會提供floor plan
. |5 \4 O: k- N' o* ~你只須做好佈局即可。
* U; @7 N# o- e1 @但是大多數的案子都需要進行佈局最佳化,以期獲得較小的佈局面積來降低成本,所以會將大部分的重要電路集中佈局,比較不重要的電路就會拆開找空間放。大部分Fully Layout會是如此。要知道電路如何拆解就需要了解電路設計,可惜大部分的Layout engineers 欠缺電路設計觀念,甚至對製程技術也非常陌生,因此只是按照過去或是別人的圖形參考與複製。當遇到不同電路和floor plan時就會漫無目標,並且想要用抄襲方式去進行佈局,如此就會需要了解哪些電路被切割移動到其他地方,這會讓你花非常多的時間在了解他人的佈局,因此進度嚴重落後降低工作效率,在時間壓力下,會覺得無力感。' Q; G; }2 Z+ ^5 M, x
% s9 {" Y( u) n# X: e' D
這樣看來似乎是承接專業能力與經驗不足以解決的案子,這是成長的機會,可以藉由他人的協助,自修或是進修,建議找專案經驗豐富的人協助,並且瞭解佈局設計原理5 D  v( d. x# e7 s3 Y1 k# D
切記!年資不等同於經驗,有些人做了很長的時間卻僅有個位數的專案經驗,有些人速度快,短短幾年就有幾十顆佈局專案經驗,佈局最不好的行為就是對著螢幕發呆,如果工作是沒有章法,那麼就會亂成一團。
) Y& g1 l1 c1 J/ F
* G+ Q$ N' e' J# M! pADC是很簡單的電路元件,應該不需要10個工作日就可以完成,如果有空可以用原電路圖,進行不同條件的佈局,就可以累積更多經驗1 U3 v( l; W  I) f) _3 [
也請小心ADC有位元的問題,只要沒有處理好佈局,恐怕會有1~2位元無法正常動作。3 F. Z  A* \0 `

) n6 C: R& E, e, W' B簡老師
8#
發表於 2010-2-26 09:21:56 | 只看該作者
分享的不错。。。
9#
發表於 2010-2-27 01:41:44 | 只看該作者
這個分享 很實在 ...
! d3 `9 @  K- ~2 ^! @"佈局工作就是要具備靠自己去完成的能力和觀念,從專案規劃、floor plan、執行佈局工作、whole chip routing & verify"
10#
發表於 2010-3-3 10:36:59 | 只看該作者
加油!撐過就是你的~經驗是靠typeout的多寡.
11#
發表於 2010-3-4 16:37:44 | 只看該作者
本帖最後由 cooky0818 於 2010-3-4 04:38 PM 編輯
0 A% ]! }0 q6 s# m# I% S! c6 J1 }
# h& Y# u- X2 R1 {加油!撐過去喔..., _0 f; S. Y% q; P# [; \9 y3 h
- D4 l: B) u5 h7 t
layout常常會遇到修改其他人的block
" }* k6 A# A( h/ M5 w' Z5 B1 s% ]% F% k+ _
定下心來...一件一件事情分開處理....9 Z: R4 |0 R, w, m; j6 T3 b
1 t% O4 I; p. Q) X1 t
加油...
12#
發表於 2010-3-18 23:07:34 | 只看該作者
我現在也是新手菜鳥~- ]3 p: ^: W4 X* o: ~7 {9 ]" [
現在都是接修改的IP居多," f! c7 @  O* S7 _# Y2 d
現在就遇到散的~要修改又要新增device~" |/ C7 s& r  _
呼~只能靜下心來了解他的電路分布再進行下一步嚕~, C1 s9 i) D9 J
現在的我正在努理累積經驗中!!
  }6 u6 `, U) @: f$ s5 N希望哪天能讀當ㄧ面嚕!!
13#
發表於 2010-3-19 08:54:44 | 只看該作者
本帖最後由 yuany 於 2010-3-19 08:58 AM 編輯
! n- o' D, H" E. T6 G+ C2 B& W" R, G' a  L2 m% w
关键是你的心态问题啦~~~! V5 \% S  d! k3 Y4 V: p
在连线的时候不要想太多~~也不要去想什么时候tapout! N' g1 R2 |/ W# n! {- ~  S8 @
因为你想的越多,浪费的时间也越多~~+ d$ I+ z$ Z9 i6 e* H" G

& p4 b1 ^# `% n" V1 K另外开心你也得画完,不开心你也得画完,你觉得怎么选择会好一点呢!
14#
發表於 2010-3-20 22:58:32 | 只看該作者
加油加油! 先從subckt開始...從小的部分驗證...做一些DRC/LVS先求對~ 再去壓一些面積或效能去求好!1 ^' O# `; h+ A6 W9 i# \0 }* i3 \7 [
相信一定能慢慢做完whole chip! ^^"
15#
發表於 2010-4-7 20:07:55 | 只看該作者
如果是我$ X( }$ o& C+ {  B7 V$ S

4 J0 i5 P1 _+ H" t. q1 S. T' L. ^我會先把原始的佈局看一次* f7 U2 y! J, C4 Z3 _

& Y" ~/ h4 E' w) ]然後重lay!
/ H+ O# W( ^4 R$ _
& M% p# \$ f+ R2 t' a) j" }因為不是自己畫的4 {/ k- q6 }: f; A5 C' u1 i
會很沒有感覺...
  N2 R" e6 y+ U# G0 s8 V2 R: A只會越做越糟!
. h1 O: q/ l  o% V$ v然後就是浪費時間!  a7 _' Y% x: a. Y! K0 x! `
最後還弄錯!
9 \6 H& m: o; v7 D4 A# i
8 ~: A$ P. z0 X5 g# M+ T不如一次搞好
7 L+ l9 [! I$ ?5 ^0 X2 S自己重來4 q7 I: e7 K1 z" J, h
這樣一來
9 h; [0 d1 t! x# o7 Q就算rd要改善電路$ T% J; |& j0 D
你也可以馬上知道改何處!
16#
發表於 2010-4-22 06:31:35 | 只看該作者
真的 最近接觸到的都是修改block 本來也有點不知所措
5 }: s9 u2 X: ?% X) ]/ \1 R+ n' E; J  w7 c5 g. U- h
看了大家的建議 希望我也能馬上進入狀況
17#
發表於 2010-5-21 11:11:41 | 只看該作者
大家一起加油吧,我感觉静下心来就好了
18#
發表於 2010-5-23 20:36:53 | 只看該作者
淡定。淡定。淡定。淡定。淡定。淡定。
19#
發表於 2010-5-26 13:57:25 | 只看該作者
先RUN各個BLOCK...看缺那些~
) Z+ ^! R0 l! m若槁不出頭緒就把整顆CHIP丟下去RUN...
20#
發表於 2010-5-28 01:21:01 | 只看該作者
恩 最近也在學layout  想到頭腦快爆炸了; Y8 {3 n) w, M0 m
0 N9 u, i  D& m9 |
加油吧
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