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Chip123 科技應用創新平台»論壇 › Chip1 -- 基礎元件 › Analog/RFIC討論區 › 多大的Buffer可推動NMOS gate
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[問題求助] 多大的Buffer可推動NMOS gate

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hiyato
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1#
發表於 2010-1-26 11:02:57 | 顯示全部樓層 回帖獎勵 |倒序瀏覽 |閱讀模式
最近做了一個Clock gen，要輸入到NMOS switch的gate，發現輸出訊號不見，3 d9 ?  g+ Q$ V! s5 m
% K  b+ }2 |* M" f3 h/ W, J
懷疑是gate oxide的電容太大，導致無法推動，在Clock gen的輸出接上一組Tape buffer後，! x3 s+ w+ }" Z% T0 ~$ M  a

# B. ]( q  G3 eNMOS switch 的訊號還是沒出來，不知道是哪邊出問題？煩請版上大大幫忙解決，感激不盡。
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hiyato
2#
 樓主| 發表於 2010-1-30 00:02:09 | 顯示全部樓層
遊客，如果您要查看本帖隱藏內容請回復
7 h1 M% e' P, G7 W5 N

. J1 w+ \- w6 h% ~- x; l電路示意圖，如上圖所表示，一個簡單的sample & hold的電路，$ Q" Z  n, |/ {, N7 d
標準電壓1.8V，Clock為理想Clock(rise and fall time =0ns；period=2ns)) u5 K" N9 V! O9 K
輸入訊號sin wave (amplitude=+-0.1v；25MHz)
8 X5 E8 L# i) z* {- j; t在理想的switch中，輸出訊號正常。
+ j7 f6 a+ u3 E+ \6 A) C在NMOS switch中，輸出訊號縮小且失真不正常。) D: o* E- E* O' C; g
取樣電容大概=400f F左右。
9 H9 y  Q) \6 k& N先謝二樓副版幫忙解答。

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hiyato
3#
 樓主| 發表於 2010-2-5 00:42:58 | 顯示全部樓層
回復 4# poseidonpid   ]6 z' ~) L" T1 I: K8 c- _3 d
3 s+ k# i8 x, q; j3 s4 R
先感謝副版詳細解說，再試著調整Sample rate與MOS size試試看。
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