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[問題求助] PLL post-sim

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1#
發表於 2009-11-18 14:28:05 | 只看該作者 回帖獎勵 |倒序瀏覽 |閱讀模式
不好意思  小弟想請問一下
% J  M9 K: D) a  A' _+ xPLL pre-sim和po-sim完的頻率會掉很多嗎1 d# X! p2 ?6 l- c. r$ ~
因為pre-sim用spectre RF跑能夠鎖定住5 j  H0 Q/ ]" e
但po-sim用hspice跑  Vctrl卻一直處於1.8V的地方( N) M. H" [) n: x! @% B; j9 B
不知道原因為何   只能猜測說 是不是po-sim的雜散電容造成頻率掉太多1 E  L6 g- r) K/ C: E
希望瞭解的版有們能夠說明一下  謝謝囉
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 樓主| 發表於 2009-11-22 13:43:40 | 只看該作者
有一個很奇怪的地方  當我跑完模擬  用.measure去看VCO輸出的頻率  也是我要的
! e9 ^4 Y( U. p' o5 D4 _vctrl卻中就一直處於接近vdd的狀況4 o5 }; q+ I5 @6 y4 A: ^1 w
我也不知道是為啥~而且都不會有放電的情況
: a  @0 w; G  X5 I這是我跑短時間的模擬圖之後的趨勢就是這樣= =( A' d# ^$ g2 C% T5 [/ Y3 Y3 B
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2#
發表於 2009-11-18 21:56:59 | 只看該作者
我建議你,先將VCO  post-sim.的tuning ragne模出來。
; ^$ y& g: V, |  A* t. w, \9 B. w  ?2 m- v
觀察你想鎖定的頻率是否超出你VCO的tuning range。. [- ?1 R  J  o4 S. h
/ K0 M% Y; F' Z! C; p+ u: l& r
我想可能是因為layout完,走線的寄生效應,導致你的頻率降低;- t- D. X) ]/ Y, G

+ |* m# Z: C# |整個tuning向低頻平移,導致你鎖不到你想要的頻率,使Vctrl停在1.8V。% X7 X1 m6 T, C" C7 B
* {" q4 J- ]" d
以上是小弟的觀點
3#
發表於 2009-11-18 23:07:43 | 只看該作者
你的pre-sim有跑過corner以及電壓和溫度的變化組合嗎??
; s. {; n7 Y2 t) I% l. P: X  z3 V  ?2 N' q如果有的話,那應該不會差太多才對4 E6 ^  g) q! O! l5 _' }) O9 Q
另外,你的post-sim是跑only c還是rc的格式( u: E+ j1 T6 e* T
因為有時候跑rc的post-sim有可能會有問題
4#
 樓主| 發表於 2009-11-19 21:34:25 | 只看該作者
我VCO的部分有單獨posim過都在我設定的頻率範圍內/ z6 z6 B7 E9 X
po-sim的時候都是跑c+cc+ F: j* }3 r; _
因為我上一踢下線也是發現這個問題  
3 e& C# D% w( h* \! M( g3 n! [這次又遇到一次  讓我總覺得毛毛的
5#
發表於 2009-11-22 04:25:27 | 只看該作者
你有考慮除頻器和buffer post-sim對VCO造成的負載嗎?
7#
 樓主| 發表於 2009-11-22 13:44:32 | 只看該作者
8#
 樓主| 發表於 2009-11-22 13:45:28 | 只看該作者
無法貼圖...
0 L9 Z' P( C# ]" @1 {- p
9#
發表於 2009-11-24 14:56:47 | 只看該作者
有關PLL電路還在學習當中,多看看一些大家的想法~~~~謝謝大大分享~~~~
10#
發表於 2021-12-23 10:13:22 | 只看該作者
最近在研究電路, 感謝大大無私分享!
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