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Chip123 科技應用創新平台»論壇 › Chip1 -- 基礎元件 › Layout設計討論區 › 求教 regulator 中ESD rule MOS該如何佈局才可以讓其功 ...
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[問題求助] 求教 regulator 中ESD rule MOS該如何佈局才可以讓其功能達到最大

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1#
發表於 2009-10-20 14:20:24 | 只看該作者 回帖獎勵 |倒序瀏覽 |閱讀模式
5Chipcoin
如題& P+ B, A2 ]" g1 s
請教前輩們 在LAYOUT regulator 時 其中有大量ESD MOS的佈局方式 該如何會比較恰當
2 ~' F4 t1 e# R: S
. Z: J3 D" x4 p9 m# Y; H% N然後又該注意哪些問題  因為我的w/l  30/0.3  現在再跑 POST- SIM.  發現到每個GATE 端電壓都不相同 3 c& M2 ^$ x( L& A+ ]' S( N

5 g% |& o7 T4 M. {) y+ r5 P請問有哪位大大知道問題嗎  然後那個MOS 為M 228  感謝

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2#
 樓主| 發表於 2009-10-21 14:10:46 | 只看該作者
就此問題 已有解決的方法了' R, x8 ~6 f8 ?, ^- u  M
發現到 應該不是我的LAYOUT問題
4 G' b0 M1 r( C- W  G( l6 G應該是我打Label位置的問題 導致 RD在抽RC值 跑POST-SIM.出現# S/ E" P0 u6 E7 t- R- O+ e+ u+ j
輸出訊號異常問題  重新標定過LABEL後 以解決此問題了 感謝( }  V# I7 ^/ P4 ]# f% ?' t, e* ~

4 l- B( @: W8 @3 b- Y, X4 f4 n  }+ S; f, s
+ [8 V- m3 `9 M3 d9 V1 g煩請站長將此案幫我做結案  感謝
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3#
發表於 2009-10-26 16:00:36 | 只看該作者
提示: 作者被禁止或刪除 內容自動屏蔽
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4#
發表於 2009-11-20 17:16:29 | 只看該作者
回復 2# clarkhuang
/ Z- A7 h4 O0 }) A7 p- _
6 I0 I. F3 t2 z" Q
' U2 ]8 R7 C. k6 }; e$ l' I    下次在多注意一下就好
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5#
發表於 2009-11-20 17:18:09 | 只看該作者
LAYOUT要靠經驗的!!!加油# i4 A# B2 o5 P( q. k: o/ ?
LAYOUT要靠經驗的!!!加油9 ~: [  y: L, @7 ]. g
LAYOUT要靠經驗的!!!加油
8 ]" L9 \* A5 b) I% r0 C: W3 W; ILAYOUT要靠經驗的!!!加油
( b+ t6 s! k8 a) A1 ZLAYOUT要靠經驗的!!!加油. [7 [3 M3 ~& {2 B/ w6 F
LAYOUT要靠經驗的!!!加油
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