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[問題求助] 關於PLL的reference frequency

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1#
發表於 2009-9-17 16:58:15 | 只看該作者 回帖獎勵 |正序瀏覽 |閱讀模式
請問一下 PLL的reference frequency要怎麼給比較好呢  是不是有一些特定的規格還是其他的方法  W, s. L9 {$ E
請版上大大指教一下囉 謝謝
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7#
發表於 2009-10-10 11:36:21 | 只看該作者
reference來源不外乎內建的OSC, h0 I3 E0 I" S1 M! T
以及外加的XTAL! s* F1 K0 e, c. ~: b
實際運用上都會配合著跑( X' u' n7 G7 K& R# W
這樣才能看出實際的效能
1 ^1 Y; n: E: a9 X* eXTAL可以查出等效電路配合著跑+ D) i! Q* r3 f7 i( z  j
所以需要加晶振的電路- _  o" w5 m" ?2 L7 f: A/ M
有些IO已經內建晶振電路
( F2 H% N! x7 C+ V& f所以可以直接使用
6#
發表於 2009-10-5 11:33:58 | 只看該作者
先決定好你是要用在甚麼application 上才來決定Reference 吧!
( N: |. }/ S- u: U. C+ m如果是沒有規定,reference frequency當然是越大越好.
5#
 樓主| 發表於 2009-9-21 12:53:59 | 只看該作者
謝謝您  因為學長他們通常都是給10幾M左右. o. h4 E% x* a# u- Z, w5 N
因為之前不解他們怎麼設定這些參考頻率  才會來版上問看看& s8 ]6 t7 w1 M0 y
我再繼續研究囉
4#
發表於 2009-9-20 15:55:45 | 只看該作者
不是  O6 V5 F9 X8 Z: u
reference input frequency會和VCO的振盪頻率,以及pre-divider and post-divider有關
" z" L. b- A8 F' h' j& g8 Z1 J通常決定好reference input frequency後,就會接著決定PLL的一些參數,因為這些都有相關性
/ v2 G. [4 q( d% ureference input frequency通常不會太高,一般而言,大概小於50MHz之內,當然,也有例外高於這個值的0 ]$ s4 C; ?, I: r: |% e
總而言之,看系統的應用來決定
3#
 樓主| 發表於 2009-9-20 14:32:29 | 只看該作者
所以說參考頻率可以隨便給囉∼是這個意思嗎
2#
發表於 2009-9-20 10:31:33 | 只看該作者
一般來來說都是由外部的XTAL來提供reference input frequency,然後再由PLL振盪出系統內部需要的頻率出來
2 e  o0 G; z0 w6 Y8 |7 n" g# r另外一種則是由系統內的clock或者chip內部的oscillator來振盪出低頻頻率,然後再由PLL振盪出高頻的clock
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