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Chip123 科技應用創新平台»論壇 › Chip1 -- 基礎元件 › EDA 設計討論區 › 求含latch的verilog code
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[問題求助] 求含latch的verilog code

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1#
發表於 2009-8-8 21:46:13 | 只看該作者 回帖獎勵 |倒序瀏覽 |閱讀模式
各位好
. {# D! b5 ]9 @, i- m9 J
; q" J( s6 O6 G! L小弟想要一個包含latch功能的RTL verilog code1 N7 B% b, B: D8 a! \  r
位元數跟型態暫時忽略，什麼功能都可以(乘法器佳)，小弟只想參考一下. B" t; _7 S3 w9 E* E4 u1 M
有的話可否給一下嗎謝謝^^
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chppy
2#
發表於 2009-9-29 14:48:41 | 只看該作者
4x4的瓦勒斯pipeline乘法器) {0 X0 `( p' M0 W' p1 x

" C- l6 U/ N8 g  N希望對您有幫助^^

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