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[問題求助] 如何預估 spice netlist 的 area ?

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1#
發表於 2008-1-16 14:17:49 | 只看該作者 回帖獎勵 |倒序瀏覽 |閱讀模式
假設我有一個 spice netlist,
, z! Z# R" Y* \$ @. ~請問有沒有可以預估這個 netlist 大致在 layout 完後area 大小的相關軟體. 或方法
. R( {, ^0 K9 w# {8 P謝謝大家
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2#
發表於 2008-1-16 14:33:14 | 只看該作者
看是數位的  還是  類比的!!
& m5 V. R( h* `, F通常數位的比較好估,因為每一個 cell 都有 chip size,所以 total chip size 與你所使用的 cell 有關,所以可以估算。
- D+ m5 J+ ?: O2 v, t( l類比部分  通常是概算吧!! 先 layout 一些 cell,然後就可以粗估了,拉線可能再乘以1~2倍吧!
5 W9 q& F4 b3 y  }1 {" r5 \8 z6 a最後再加上 ESD/ sealring 等相關的應用之面積。這些都是一個概念值!!
3#
發表於 2008-1-16 19:51:29 | 只看該作者
跑線的area若不算的話是可以寫program來預估
1 \' z+ |" Z# t/ B/ c& `以一個10/0.5的device為例,8 Z/ |. ^/ D9 u  B& I6 W$ V
x = 10 (Width) + 1 (假使active to active spceing為1的話)=11  X4 S. C5 O0 v5 U4 Z3 U
Y= 0.5(length) + 0.25(假使ploy to contact minimum rule=0.25的話)*2(有2邊) + 1(contact size)*2( 有2邊) + 1 (假使active to active spceing為1的話) =4
$ p, V1 _4 D* K, m) D  x: ?" t& K可得此MOS size為X*Y = 44 um^2# ?; j" I9 v7 p- A1 W" ~
total area即為所有MOS的總和

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4#
發表於 2008-1-18 01:54:02 | 只看該作者
這算法看起來是直覺的方法,; `' g4 f0 h1 }4 i7 X
與實際佈局面積仍有差距,1 ~+ j2 {3 c& P# w- M# P
畢竟layout會用到很多技巧,( v$ s1 x5 x' R4 ^5 _' |) A
如何降低估算面積與實際面積之間的誤差,
* f5 Y# R. [, v! e這應該是很多layout工程師的經驗吧!
; |* `8 _. b1 b& }7 {, |1 k: [8 N可惜教科書上也沒有講到很詳細的估算法則
5#
發表於 2008-10-18 14:14:16 | 只看該作者

大概是這樣

看這本書吧他有講簡單的如何估計1 P& @. _( K0 b4 [3 |
Neil H.E. Weste and David Harris, CMOS VLSI Design: a Circuits and Systems Perspective, 3rd ed., Addison Wesley, 2005
) ~! T; d. |3 c! f他大概有獎到一點
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