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[問題求助] Power MOS架構問題

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1#
發表於 2007-12-27 17:20:38 | 只看該作者 回帖獎勵 |倒序瀏覽 |閱讀模式
有誰公司有畫過類似Power MOS架構,能在TSMC製程畫嗎,如果能那W/L如何計算,因為Poly會有重複的問題需要知道。3 M5 J+ W* d, E

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2#
發表於 2007-12-28 17:47:41 | 只看該作者
左手邊的將POLY重疊的部份去掉假設POLY是1U+ D4 p3 R, K1 Q' e, |
POLY to POLY是2U  每條POLY 為17U; v7 x% K' Y3 C, x
17*10-5*5=145! t! G0 n. S! C1 i
右邊這個就沒有重疊的部份,但卻有打折部份的損失,  }# _+ ^5 u, Q% ]0 O* @) l
看你要多精準,粗略的打折部份就算是1/2,
: N( c7 K1 u9 B9 q就這樣子
3#
發表於 2008-1-3 09:50:01 | 只看該作者
通常  POWER MOS 應該不用算到這麼精細吧!!
8 G5 N* Y2 e; b. \& c; [4 H/ W他是看整個 Rds(on) 所以  這些的誤差應該是可以忽略的吧!!& q/ J) G" m4 B- y# F
口字型要看她的整個結構  還有引電位的問題!!
& p! h* m0 ~" M  d6 \; R口字型  應該是對稱性的結構比較好畫!!
1 ?- C# i4 M4 u% e  b% {$ y, m" q若是 DMOS 目前還沒有實際的使用過!!
4#
發表於 2013-1-31 14:48:12 | 只看該作者
Rds(on) 是什麼??3 ?/ ], G; j5 o6 h: \" {" L" s# p
怎麼判斷Rds(on)?
5#
發表於 2013-2-27 15:29:18 | 只看該作者
希望各位讨论,多谢大家, 。。。。。。
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