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像是自己在設計電路
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然後趕在CIC下限前
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拼命的LAYOUT5 I( c; t0 y' S' N1 ~
4 S- m1 ?; `# k+ T有時候,老師說要改規格
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或是其他人說你的LAYOUT要考量一堆要件時
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+ D2 }% @$ L( u: u5 y1 n4 c2 ^ u那時候真的很吐血啊∼!∼! ?- y$ l+ R9 _ E- l# x/ S2 t, n
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像我個人就覺得LAYOUT真的相當的累人( F8 G; J3 M3 V" @1 T0 }8 m4 ?
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尤其是再跑LVS的時候
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% k( i$ A- Y) D+ b$ \8 P4 R除錯debug真的是要人命啊∼!! |
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