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[問題求助] 關於PLL的頻寬

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1#
發表於 2008-10-10 23:19:02 | 只看該作者 回帖獎勵 |倒序瀏覽 |閱讀模式
我看書上說% r9 e7 j, d* T4 _4 _
"迴路頻寬太小則迴路反應慢"
* O% D  h" _% M1 v我想不透這是啥意思...QQ
: {* f$ C. x) A" z/ w
4 W& Q6 ]+ s, w! n; |# ^以前學的頻寬應該是定義w3db(high) - w3db(low)
% K# H0 e( v2 `所以直觀就是操作範圍要在頻寬內
" V, E5 T9 F1 s: c& `4 J  k" S$ h, k但最近看了一些書* `: L5 |; t3 a( y* B% N
有點搞混" ^' Q7 j4 o' S! W/ p( C! y
想請問各位頻寬有沒有代表啥物理意思+ _3 y% b: O; D( b; n
(ex:追的速度快之類的)
* W! _- T* y$ l! @9 G感嗯
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2#
發表於 2008-10-11 15:54:00 | 只看該作者

迴路頻寬~~  要看電子學  迴路頻寬~~  要看電子學1 d5 r( T& x( x) w
這樣教你   你才比較懂  你先看看書 我之後再回你
3#
發表於 2009-1-7 23:09:13 | 只看該作者
迴路頻寬小,迴路反應慢  也會造成鎖定時間變慢0 \/ v; n( O1 E5 H5 z9 z$ w
但此得到的優點是得到較低的phase noise
4#
發表於 2009-1-9 14:57:05 | 只看該作者
對PLL來說,3 w# t+ X+ Z, s, F! [
頻寬大 -> lock快 -> 但是jitter較大7 R. ~$ A4 r/ I3 h- x7 e
頻寬小 -> lock慢 -> 但是jitter較小
5#
發表於 2009-1-11 20:47:01 | 只看該作者
感謝樓上的分享!!原來PLL的頻寬有這樣作用,先前我也是不知道呢!!
6#
發表於 2009-2-3 16:02:48 | 只看該作者
所以說這是設計PLL的trade off.2 D; O, [% r% `3 _
人人都想要jitter小, 但又Lock快的電路.
7#
發表於 2009-6-12 13:39:58 | 只看該作者

這就是PLL的精隨阿!!

讓小弟我來稍作說明一下!!) z- `" r& ~8 s' K5 v- ?- o
7 z8 C* H& y+ b1 K
Type2的PLL基本上就是靠PFD將相位差偵測出來,然後藉由charge pump(CP)電流對迴路濾波器(LPF)充放電
/ g  T; a2 E& ~% u
! E) q4 o* `' C8 f6 z9 g所以重點就是..迴路每一次修正的速度就會和CP電流與LPF值有絕對的關係, m8 g7 a8 o0 h2 c$ Y

" f; K! ~1 o3 y2 U而LPF值是藉由整體系統穩定度之分析所得來的,因此才會有人探討BW對於系統之影響...0 F( K* @4 j; g8 j  v" a4 F0 Z

/ c; e4 G: W% @: w" I, {-------------------------------------------------0 R& e. @: R5 ]: b& D  p! y1 p

8 X5 z$ R1 R5 l; r- u; N用一個推導過後的簡單關係式來看 -> 迴路頻寬和迴路濾波器的電容值成反比(very important)$ H0 T( ~' ~; k) M) o( o
0 }/ m6 \7 P' L" @* f
1. 設計時若取"大"迴路頻寬,計算出的濾波器電容值較小,在電流量一定的條件下,每一次充放電的位準增加較快;
' k" E1 v) h' J3 y5 X/ l. O) E. l! D. P  H$ T
2. 設計時若取"小"迴路頻寬,計算出的濾波器電容值較大,在電流量一定的條件下,每一次充放電的位準增加較慢;+ `/ t- F# M0 y
  s& Y! u1 E5 k( ]0 H
以簡單數學式來看 : 大BW時為I*小C=大V(一次變化量大) ; 小BW時為I*大C=小V(一次變化量小)
$ x$ S/ k5 B7 D" X4 Y; N. j
/ y7 r6 {  z% D5 K0 o1 L由以上關係式又可得知 : 大BW時修正變化量大,所以很短的時間內迴路就會穩定 ; 反之小BW濾波器值很大的條件下,電菏幫浦對大電容來說其每次只能產生一非常小的控制電壓變化量,所以鎖定時間會拉長  A5 v$ \! J' f; B  B4 j
- i) h, Y5 D8 z! q5 H
總結 : 9 W( z+ q+ R& v4 U  Z) K1 L
+ [. ?1 @8 A8 b% m; T2 ^- k* V8 Z9 [
大迴路頻寬 -> 較小的FILTER SIZE ; 鎖定時間快
( @2 U) F/ `( |( V7 H) G
) l$ A" H: d# F. j小迴路頻寬 -> 較大的FILTER SIZE ; 鎖定時間慢

; |3 B% m* O2 ?3 B$ O# k4 Y* K1 y- q-------------------------------------------------
+ ]0 h7 F. H9 h
& T7 q' G9 q  P) ^3 ^但在抖動方面沒有一定的定論,因為你要看NOISE是從哪裡來
0 E; u' ]6 }( q' _0 }3 G4 k2 V
5 e6 H1 U3 M7 a0 A- C1. 一般來說,若當系統的輸入訊號有較大的抖動時,如時脈與資料回復電路的應用,則此時必需選取一個較小的迴路頻寬,因為整迴路可看成為低通濾波器,若你迴路頻寬設定的越小,將可抑制越多輸入的雜訊" N) \& c: |; f

8 V# H* C4 r4 s3 s% K# ?2. 但是若系統要求一非常穩定的輸出,如頻率合成器的應用,則迴路頻寬就必需設定稍微大一點,因為電壓控制振盪器為一高通的特性,頻寬越大,將可以抑制越多高頻的雜訊。
" O0 O" F1 ]! V/ j 0 v& {0 n, I9 b$ F
因此在設計鎖相迴路或是延遲鎖定迴路時,如何選取迴路頻寬值是沒有一定的答案,
- e& ^7 D6 O' t. o, \: r4 v
5 p! o6 S2 K( W/ Z# J; V迴路頻寬和系統的抖動、鎖定速度、迴路濾波器的值..等等都有密切的關聯性,要視應用而定
$ Z, {% T8 Z  s$ o7 t1 ^2 u' Z! T0 ^; o2 W
以上為小弟之淺見,若有問題再一起討論囉!! Good Luck~

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semico_ljj + 1 + 1

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8#
發表於 2009-6-12 16:17:36 | 只看該作者
瓦,很多內容,謝謝各位大大~
# n) G' S& Z5 V6 _+ r; R0 N謝謝~對於pll我是一個starter,原來有這麼多的講究和奧秘~
9#
發表於 2009-6-15 11:42:58 | 只看該作者
Very good answer, I've learned a lot
10#
發表於 2009-6-18 23:40:56 | 只看該作者
B大好厲害喔~!!!( C% k# [6 k3 @1 g
超感謝B大的講解~!!!
0 Q! \. C5 ~: }& \" i5 s5 V9 W剛好跟大大有著相同的問題~^^
11#
發表於 2009-6-19 13:14:28 | 只看該作者
謝謝B大的解釋( g+ n: j8 l3 J/ I) }
. N& P" o! A2 j& t
最近也是在想這些問題
* C2 c9 _9 k! q& K% n
8 p8 L6 K$ ^0 \4 n1 a! b* p5 z0 m8 J但是沒有像七樓大大這樣完整的思考
12#
發表於 2009-6-23 17:08:48 | 只看該作者
谢谢上面的解释( {9 @! b2 c$ C4 p. b! `8 d. D
真的很详细 透彻3 Y, m& L; L) V1 g
谢谢了
7 m) C. V6 o4 x/ s) h# M
13#
發表於 2009-7-13 04:04:05 | 只看該作者
建議你看書中對於PLL 鎖定時間的推導公式。你會發現鎖定時間確實在式子上是跟頻寬反比的。
14#
發表於 2009-7-24 13:37:34 | 只看該作者
感謝大大的解說和提出,最近正朝向這專案邁進。
15#
發表於 2009-11-24 14:50:08 | 只看該作者
Very good answer, I've learned a lot
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