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[問題求助] FPGA外接DAC電路??

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1#
發表於 2008-3-6 17:44:52 | 只看該作者 回帖獎勵 |倒序瀏覽 |閱讀模式
我想請問一下~ 其實是一個dac小問題  G4 n8 y* D  w( h% j3 G
dac輸入部分有區分成serial和parallel 那連接fpga 若我送一8 bits的訊號 速度假設是8MHz: Y3 |1 h8 O; @$ F' r# ~
那serial型的DAC輸出速度不就剩1MHz. L4 b& j6 D4 E/ A: m/ L& ?, ]
(我是把他想成說是一個一個bit排序接收完8個~再判讀輸出)
8 {+ D( A+ W& q$ b! u! w& e而parallel型輸出仍可以8MHz
) A* f/ w! \) @" O我的理解對嗎??9 t. P, R4 X6 C& n! m: h
有人可以分享一下如何挑一顆適合的DAC嗎??感謝
1 ^5 x2 a! [& g對了~還有spec上會寫多少channel是什麼意思呢??感謝
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2#
發表於 2008-3-7 10:00:39 | 只看該作者
挑DAC?
) m! p& ~" r# {, M* P1. 輸出的dynamic range" ^4 p+ ~+ N2 X; y5 S
2. output resolution
  m8 g. v) r  U- b, |1 z1 i3. bandwidth. O$ V/ S$ n/ T7 b
4. 線性度
' H0 L9 E% O) P8 x4 G3 I3 C5. power supply; E# @: M" ?: L' s
6. interface (serial / parallel)- T. r' Q2 j1 B6 H
以上幾項都滿足project需求的, 就挑到了! t. t* P. A4 Z4 {" l: g  |+ F
7 F6 R, u+ R* c  ]. c
channel?0 z# w& Y" I+ U/ U$ {
一個package中包含了幾棵DAC, 大概可以這樣看; n: v0 c& G& M- D" M. y

4 @# |7 G3 O" ^6 J提供一個問題, 假設DAC是 12bit, interface是8 bit, 則interface跑
( e2 S/ r% o# Z3 |2 V( d( W- h* K1 Mbit, 那最少要2 byte才能update DAC的輸出, 再加上一些有的沒的1 ~! L1 U2 o; G7 C6 V" g
所以頻寬部份怎樣看, 還是要仔細k datasheet才知道
3#
發表於 2008-3-11 11:51:23 | 只看該作者
基本上, serial DAC只是為了省管腳, 速度上自然不會太快
3 K- g% I0 t  m" s  M. j, D7 H* O實做上, 要先訂出你要的規格再來選, 答案很快就有了.
4#
 樓主| 發表於 2008-3-29 23:54:16 | 只看該作者
版主~您所謂的定需求是指~??
% G0 T4 I, }- a$ s. [4 n% ]: i# L
# A' I: \# w( |" k8 {我的話就是DAC輸出能越快越好(用於光學實驗)/ ~6 _2 s  [" Q' ]# w
=================================================
7 L" o) T, m9 A/ p  u不好意思~
9 z4 y4 `( R8 K, K. ]# w( }* E  k: {: C+ G9 K3 k
我想請問幾個問題
( Q) I* B. P: W8 i( V, P0 b, x2 `/ u
像Xilinx FPGA
* K/ @9 ?% p, q+ `9 m" t( http://0rz.tw/193QX )
% t; ~. E5 N% q
- Y( s5 J% T  G% ni/o有提到0 k: F+ z2 r8 k+ d# W* }: p: [7 q& Y
) [1 \9 @3 u/ z/ _7 g+ ^
分成selectI/O和differentialI/O
4 I5 k% y, h: C' o; u0 p. ^
2 @; k/ C) O- z4 y. I8 y是說~; k9 k& ?5 [8 u  ~$ |! d, H( ]
2 h" I9 R5 w+ P% u* t* f; a
因為我現在要用FPGA外接一顆DAC作光學實驗$ T5 R( ~" y& M4 i% o% }

& Q; k3 f, _; x; y, e若我選用的DAC傳送介面是LVDS或是RSDS這類~
) ?9 V" H6 E2 `# x5 s, @! z" [  e' |
那fpga它速度上就要看differential i/o這一項嗎??
. s# V' `, D7 u8 d) V
$ \* W3 w. q/ u因為高速的DAC介面大多是LVDS
) e2 E3 }7 Z' U* s2 P" Z  }# U) v0 ]
9 G, q& K: z( r7 `3 L8 j: k==============================================' ~8 K# s* @- \2 W  u& E/ ^- s* L

& Y% d: [: c) g* K$ q  t像這一顆(AD9734)
% E0 \8 f: B3 ]+ z2 Bhttp://www.analog.com/en/prod/0,,AD9734,00.html0 h- [& q5 h/ D- O! `( @- J

8 z2 S% M5 S' C1 Q他介面寫說用LVDS
. c) @" ~9 y' j( p
) u1 u8 D- m  q7 P- q但又寫著, @* n+ ^$ p+ q& V
Double data rate (DDR) LVDS data receivers support * D3 c! d4 J! F; B. k
themaximum conversion rate of 1200 MSPS., `% P# O& C* ?  e& e& G
: m9 m  ~! R0 ]9 V0 X
我搞不太清楚  = =?
$ T! b% s7 E7 Q: I/ ^3 T8 {% a/ T" W, j( E# h: M7 _
==============================================
5#
發表於 2008-3-30 17:13:49 | 只看該作者
簡單的說..., E) n9 `; q* f4 w& C9 X
& R6 e% T, t9 x7 t0 H
你需要Virtext-5的FPGA (可以傳1.2G LVDS)去配合AD9734
- D! C; _; H- f" W+ S& Y7 C( X4 Q
) o. z) T7 G  x: R好巧...二顆我們公司都有賣
6#
發表於 2008-11-24 15:37:47 | 只看該作者
I had trouble to control AD9734  from FPGA. Do you have some examples ?- _1 t$ Z3 I- E3 j) t6 I2 k

6 g" s6 C/ j4 u; m3 JThanks
7#
發表於 2008-12-15 16:32:12 | 只看該作者
有電路圖嗎?' e) K9 \' K0 q4 g: i( j. `
至少先看過FPGA跟AD9734的電路才好討論
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