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[問題求助] T18 DRC LUP3.1g_1.8V

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1#
發表於 2013-10-7 23:48:56 | 只看該作者 回帖獎勵 |倒序瀏覽 |閱讀模式
本帖最後由 aj002547 於 2013-10-7 11:51 PM 編輯 6 A- Q3 i2 P' O& A' |; M6 c; i

, C$ h7 o& t& j- I0 j: F: ]各位先進好, 小弟有遇到一DRC錯誤不只如何解, 想請教各位
0 d; A$ q& s2 P7 T6 U6 F. O* V9 L$ L% S" ~; W6 s$ Q( B
圖片的反向器輸出有接至PAD, 但cell都是畫好的,
- e" W/ t, O; M, D( D: b
7 D0 z* F! w8 S0 ?* W( n% _難不成真的要把這塊拆開然後拉開到他所指的3um這麼長距離嗎?
" i$ d0 V# B# U. j# o# |' a2 a/ ^$ E
還請各位先進有處理過的幫忙, 謝謝- x2 g& \0 E2 K. G! u" ~  q

; z7 S4 B( w! s: q; {& Y
7 X$ p( }1 L0 N
% [3 M  i, O3 ~0 J: M2 A/ `! z0 T- V4 }: l, H2 \+ ]9 S( l6 J
highline處為紅色框起部分
5 D6 u1 B- B- i# W1 b

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發表於 2013-11-8 07:39:24 | 只看該作者
您好:* w4 R  i+ O+ i/ _. {3 U/ m1 \
/ j4 n; d- P. M- L7 Z  T
       我簡單的按照DRC RULE上的字義跟分享一下我的看法,應該是說如果你的N/PMOS有直接接到PAD的話,你的NMOS就必須要圍上DNW,而且DNW跟你的PMOS的NW必須距離3um以上。& }4 v$ a, e7 I* S5 M

$ h2 O- b9 n) p6 }7 Y  [- E        我猜這應該是為了ESD所設的RULE,因為在PAD附近較易有大電流,故拉開N/PMOS以防止LATCH UP產生。
. I% S/ {6 U) c/ X- g( u& Y
; {2 ]7 M$ Y; D% D以上希望對你有幫助。
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3#
發表於 2014-5-21 18:14:38 | 只看該作者
LUP  廠 rule
. V" v6 D5 O( @
! g! c1 c6 o8 F# @+ lspace  between the NMOS and the PMOS
4#
發表於 2014-5-21 19:14:49 | 只看該作者
請把PNMOS 拉開 並為一個完整的ring
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