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請問我有一個電路 裡面有兩個獨立的ios pmos
- ^0 I8 D" ~ A1 e& G( K) y9 Q7 x% s" m2 u, p. i
一個body 接power 一個floating
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; W7 i+ `2 c2 p* j. D* B我lvs 驗證後 ,出現 floating 那點的net對應不到 ,但如果我在floating 那打上 和netlist 一樣的netname 就認得到 但是會多一個pin的錯誤
: `3 i% M( q/ Z, p0 b6 T
- J) n& n7 H3 ^, S- L" `# j/ U我如何能在 不出pin 狀況下 解決此問題' f! i6 g3 y( }: s4 y1 h- \# q
% w/ I2 I: r6 |( R. o$ t/ H3 ^- T* o
我power name 有宣告! _# g& M( y" K( W$ ?) I
4 ?) L* ~3 v- K @1 F+ ]
但出現miss name 的是 我iso nwell 需 floating 的mos 我那mos 不接任何電位
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8 V: t5 J0 J& x8 \但lvs report 卻對應不到 出現兩的錯誤 分別為
0 I; ?0 Z9 ~ @! e* g; \8 x/ O3 ^$ z! S2 `$ O5 D' \/ x
layout name source name9 c* ^0 Z6 P+ ^( I, _6 n' J
-----------------------------------------------------------# Z+ r: O, d2 x: U3 f
**no similar N_111
+ J* O7 K% u% m0 C( {* x% h; e9 K# Z/ i" b9 k4 Q9 z6 r
NET 18 **no similar
3 |2 c. \0 P: q, Q( \ [8 H: A! i( w' e
但我如果 LAYOUT 打上 N_111 兩條線就會對應起來
: o5 P4 @9 w0 \% A! G4 j* p, Y% y3 a y$ L
但那不應該出PIN
" [5 R3 G( o" y+ k8 V( x( e% w& s$ {7 g: I, R
) j, v3 |! K8 C2 M& m+ X我需外接電位的 都出pin 所以沒設global 旦出問題的是需floating的
, e9 K$ [7 T& n: t8 w
: o- h: H' l& g% ?9 M2 H# \# B; |% t% m) y
~~6 X9 p: |& V, x6 ]/ a5 j4 D
MMP6 OUTB OUT VIN VIN PI5 M=1 W=4U L=1U
( D9 b9 V6 `5 I2 V& L! ?5 I7 [! gMMP7 N_10 N_4 BAT N_111 PI5 M=1 W=2.4U L=10U
3 C7 q* M" l0 ~2 c~~
X8 Y1 |( H4 L! ]9 Q0 I, b7 F7 kmp6 接vin mp7 floating 但 net N_111 認不到 |
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