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[問題求助] 想請問一下設計mos的wenth跟length

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1#
發表於 2007-9-15 00:17:02 | 只看該作者 回帖獎勵 |正序瀏覽 |閱讀模式
最近一直在模擬paper上的電路,(也清楚了為何電路會這樣接)
6 Y1 B4 A4 L: G3 a4 Q5 `6 W好比說VCO,PLL的電路4 \+ U1 ]6 a' C
通常你們在設計nmos或pmos的時候,長寬比都怎麼去設計呢. j: s7 j+ q( _, T4 }  U% t
如果是以0.18um製成或0.35um的製程來說0 m2 c0 l. c4 [3 f
不知道各位專家有沒有什麼建議或指導之類的.....
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發表於 2007-9-19 10:31:31 | 只看該作者
類比的世界  沒有 standard!!
9 p* E7 G9 \# O) B( Y' S所有的 width & length 都是依照設計者的需求來設計!!
- _3 ^- l1 d1 p$ q2 E" N! ]2 w所以  應該沒有人可以告訴你標準答案!!
# o4 P3 L+ G2 E$ h: s9 d% n0 H- t或許  有這麼一條 guide line 叫做  儘量不要用到 min. length/width!!6 r3 H0 W3 I$ z* |; d
這是考慮到製程變異的時候!!  假如不 care 時  也是可以用的啦!!
  u/ c* O6 l  S9 G看你自己的需求唷!!

評分

參與人數 1 +5 收起 理由
monkeybad + 5 Good answer!

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16#
發表於 2008-4-11 15:42:44 | 只看該作者
L大小的選擇和mos的使用有關係
# [* P# F- p) n$ f/ \4 @有從match的考慮,電壓mos和電流mos
) b) P( K$ t# ]2 ^" w! b9 ?. }有從1/fnoise的考慮等等7 z( M$ ~- e( `* _/ n" f
沒有絕對
  x; x+ V  q4 M3 I0 g2 b! ~- w9 {w的選擇主要和vdsat和L大小相關
15#
發表於 2008-4-5 22:02:12 | 只看該作者
一般length都會設計在最小L的2-5倍- `; D" P2 G! d4 f2 N/ Y6 e
再看電流來設計wenth
14#
發表於 2008-3-11 13:36:34 | 只看該作者
Reasonable sizes for lengths of the transistor might be between 1.5 and 2 times the minimum transtor lengh of particular technology.
13#
發表於 2008-2-12 05:07:41 | 只看該作者
for the 0.35 process L usually is 0.4 in the process datasheet, then you calculate your W according the formula Id=1/2uCox(W/L)Vov*2 usually,But as the other guy said your specification is the first
12#
發表於 2008-1-15 21:09:51 | 只看該作者
類比電路基于match的考慮,一般需要更大的L
- \$ o, V+ o0 E6 x9 y^^^^^^^^^^^^^^^^^^^^^^^^^^^^^^^^^^^0 H4 B) }9 r7 o3 b, d
基於 製程變異 及 短通道效應 : u5 M# L1 {" w9 _5 v+ z' R- S

( d0 s, w0 F8 ~9 E; l! B% m/ L7 f4 {先明白公式,推小信號MODEL
' h. `6 E/ {5 N^^^^^^^^^^^^^^^^^^^^^^- Z4 |3 k9 ]8 e1 \/ ~$ Z
20/2 跟 10/1  在數學上是一樣的(忽略2次效應)
% l3 B' r! s( E% `& E  ?9 _- d但在 hspice 可能是不同的 mos model
11#
發表於 2008-1-15 16:55:07 | 只看該作者
2樓的是REVERSE吧...
! {7 g) K5 i% J3 K$ p4 p/ m
  u' f8 ~" K$ G: f# w6 v我想還是要以分析來設計, o& g2 S! G/ Q4 @7 ?

! V1 j. s& o# i3 ~( Z! B. k" {先明白公式,推小信號MODEL4 K% ~( h) F! O; a

% ?5 K9 h8 t# I/ w, @2 H, ?應該可更清楚
10#
發表於 2008-1-15 14:31:07 | 只看該作者
看是類比還是數位電路,
' K8 q: B6 V+ A4 u4 u$ L0 N類比電路基于match的考慮,一般需要更大的L,! z. J" n. y8 @& C2 C; S
數位電路基于經濟的考慮,會選取最小的L, 0.35um. 因為數位的處理電平都是0和1.
9#
發表於 2007-12-16 23:11:09 | 只看該作者
0.35um製程, 應該 L 都用0.35um , W可用10um或是5um,我在學HSPICE都是這樣設定的
/ H- H, G4 [8 W7 ~但還是要看設計者啦
8#
發表於 2007-12-16 19:42:58 | 只看該作者
一般類比電路的書籍(ex:Alan..)都會提到喔,大部分都是以OP當做例子,利用OP的規格去回推MOS的SIZE喔.
7#
發表於 2007-10-26 13:49:55 | 只看該作者
Sorry, I would say they are total mismatch!
6#
發表於 2007-9-21 19:50:54 | 只看該作者
比如W/L=12/60. 和这个20/30。match怎么看
5#
發表於 2007-9-20 16:46:12 | 只看該作者
一般在設計NMOS或PMOS,為了讓MOS在飽和區工作,以所需要的電流(Id),再利用MOS飽和區電流公式Id=1/2 u Cox (W/L)(Vgs-Vt)2來估算W/L的比值,
$ L* ]1 L. r8 r! V1 J0 [) n! |另外,如果是0.35um的製程,表示L最小可以到0.35um,但建議不要用到最小,因為如果製程不穩,L很可能會跑掉,而造成電路Function功能不正常。
4#
發表於 2007-9-19 17:04:53 | 只看該作者
L與W跟你的操作電流、頻率盛至跟溫度有關
5 r4 k2 G+ h7 v一般L的不要抓到min值,L大一點可以避掉製程size的變異
6 y# X5 P( y: {$ y9 D* P% s適當的W/L比例控制去抓Veff值比較好
2#
發表於 2007-9-16 18:56:58 | 只看該作者
根据工艺确定Length,然后根据MOS的功率和速度确定wenth。
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