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[問題求助] 請問那裡有op amp的layout圖及反相器各材質間關係的介紹

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1#
發表於 2007-8-20 15:47:06 | 只看該作者 回帖獎勵 |正序瀏覽 |閱讀模式
因為學校教我們第一次畫反相器時,各層材質之間的關係 是由學長帶 並且學長自已本身就講的就是非常的馬馬虎虎不是很清楚。
2 x4 N7 ]" @& d$ {而畫過反相器後 我們才知道1棵cmos 原來就是要這樣畫都已記憶了畫法,但如果等到工作面試要詳細介紹各層材質間的關係及各材質是
- k8 g2 Z% J2 t7 ~" m$ L( o什麼? 這點 我就非常擔心了!因為已把結構就像畫圖一樣記起來 一棵n型或p型電晶體固定就是要這樣畫早變成記憶 。
* z" O2 ?2 S4 o# V  ?4 Z8 `2 j所以請問那裡有資訊有特別介紹關係嗎?" a2 o/ T8 K4 R5 P2 Q
還有另外那裡有op amp的schematic圖及layout圖
; ?3 g$ m! |+ j- C: D! Q小妹我手邊的書並沒介紹到op為例子的圖 ,但想要問一下 先進們網站上那裡有提供 麻煩一下謝謝^^
6 D" u; p; [6 w& \) q* V6 T, T(另外含有介紹op amp各層材質間的結構,這樣才好記憶這元件畫法)
" `) c# D$ j( Z. d/ j! h% Y
0 \2 `$ U$ w" B& D# Z4 P' d[ 本帖最後由 君婷 於 2007-8-20 03:50 PM 編輯 ]

評分

參與人數 1Chipcoin +15 +30 收起 理由
jianping + 15 + 30 Good answer!

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24#
發表於 2011-9-9 01:51:46 | 只看該作者
感謝大大的分享,在晝bipolr時又更有感覺了。突然發現全部都看得懂在說什麻耶。
23#
發表於 2011-8-13 17:38:33 | 只看該作者
我也是layout新手 一起加油努力
22#
發表於 2010-5-1 18:43:12 | 只看該作者
正在學習當中!
4 v/ l: y. W- P4 K' P3 n受益良多!!0 u9 k: m  U* K; j( Z+ h* D
謝謝!!
21#
發表於 2009-11-28 16:48:31 | 只看該作者
參考foundry standard cell 是個很好的思路,受教了,感谢
20#
發表於 2009-11-14 17:11:20 | 只看該作者
好多不知道不熟悉的東西! X$ ], `0 Q8 Q
謝謝大家的告知
- `# g+ @$ t  f1 U1 c又學到了很多
19#
發表於 2009-10-23 21:10:43 | 只看該作者
感謝分享好資料,可惜我沒有錢可以買= =5 Y( `$ W6 v: N. c) u4 x4 Y
錢花得太快了,又賺的太慢.....
18#
發表於 2009-8-11 13:17:14 | 只看該作者
我想對一個layout新手來說
( x. x7 f* @# ?% s) m1 \6 j能有更多的前人心血結晶來參考; J2 o$ |5 ~2 T  [1 N
應該能更快進入狀況內吧
4 ]8 U* {  a4 [8 }6 |+ N( `4 b* `( W6 g# o" h; z
感謝樓上幾位大大的不吝分享!
17#
發表於 2008-12-16 23:13:17 | 只看該作者
要在什么用户组才可以与大家共享知识呢
7 |: \, q5 a6 C: }9 \6 ]希望班组能告诉并支持我,十分感谢
16#
發表於 2008-2-2 14:43:12 | 只看該作者

回復 11# 的帖子

我也無法了解 11樓的回覆  Why 可以得到
# {5 G+ k* [% ]7 l& b  H這麼多的感謝  與這麼多的RDB ???' V+ @# ?4 q6 r- z) p' e( u3 m
7 e1 X8 S- ]2 ^; o9 ]- P+ C9 W
依我來看  3樓的回覆算是很好的建議
, S3 g4 E# y! S6 BTSMC的 Cell Library其實也是經過 精簡再精簡的畫法
) f5 _9 t2 U1 G% F入門者去參考  自然可以從不會說話的 Cell Library上
$ b* c: u$ j* d4 b/ I( y學習到一些有用的技巧8 T; Y8 q; X( k  h3 @

& v1 y* e) L+ q[ 本帖最後由 yhchang 於 2008-2-2 02:45 PM 編輯 ]
15#
發表於 2008-2-2 12:50:42 | 只看該作者
電路都可以利用到最少空間不是那麼簡單耶
14#
發表於 2007-10-24 13:40:17 | 只看該作者
Layout的學問真是深不可測,沒有進入這領域,不知其中奧妙
13#
發表於 2007-9-3 17:35:46 | 只看該作者

ganxie

好多自己不知道或者不熟悉的东西,                                 
. {, v# }, y+ n, J谢谢大家了
12#
發表於 2007-9-1 20:37:42 | 只看該作者

回復 #11 SANSUI0304 的帖子

jianping  ?????
8 \: F! [+ c" P) O
2 ]2 [; W6 l( u/ T4 Z) T  V# K評分很奇怪,看不出哪裡是Good answer!
11#
發表於 2007-8-28 22:55:08 | 只看該作者
謝謝你的資料,但是我的閱讀權限太小不過還是謝謝您了

評分

參與人數 1Chipcoin +15 +15 收起 理由
jianping + 15 + 15 Good answer!

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10#
發表於 2007-8-27 11:02:59 | 只看該作者
看来我的回答另大家不满意啊 那我再详细说一下我的想法啦:
( ]8 M- ]/ G) J% e( m) E+ M6 Z$ _8 c4 G. n, W) ]# F9 A9 {, e1 w
如果只是简单的学习layout的流程,那么可以找一个实际的工艺,至少要有工艺文件也就是technology file,在这个文件里你可以看到工艺包含的layer;还有如果要画一个可以生产的layout,那么还需要design rules manual;最后需要的就是verification tools and rules了
7 c% Y. z/ a' \9 A3 @
4 h# Y: f8 G* C! A楼主问到的问题可以去:www.edaboard.com
& q. f8 G' c8 K: \( K$ p9 P, r9 t8 E8 ^# c2 L+ `
那是一个不错的论坛,你可以search到很多有用的资料& L1 h0 r1 H1 f% R( @# O0 c1 v

" e) j) K# ]1 Y/ }

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參與人數 1Chipcoin +3 +3 收起 理由
world776 + 3 + 3 感谢指点和&#3121

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9#
發表於 2007-8-25 00:15:04 | 只看該作者
太感谢了
8#
發表於 2007-8-24 21:55:11 | 只看該作者
想到2個
+ c! h4 O2 j4 ]4 S& F/ W! d3 b) ?2 L8 t0 p+ l+ n( s: u
RPO--> 我看過是指Poly電阻一般用Poly2
& ]/ I: K6 Q# R! N6 aDNW-->指的是deep Nwell(深層的NWell)
7#
發表於 2007-8-24 20:32:16 | 只看該作者
CB-->指的是PAD layer,一般作為Bonding PAD的定義範圍,且為倒數2層metal的連接孔。, U/ V; \5 u! m, v, C* B0 G; g
UBM-->一般只的是最上層金屬,或為Au targe。2 ?6 }- w( J7 Q- U
Fuse-->ㄧ般用poly1 poly2 或metal
1 G9 A" r. o7 N9 e2 b) B  j1 tVTMP-->為PMOS 用的參雜# Q" o. f( |: f4 i8 T* h% s
VTMN-->為NMOS 用的參雜

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參與人數 1Chipcoin +3 +3 收起 理由
world776 + 3 + 3 多谢指点

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6#
發表於 2007-8-24 11:26:18 | 只看該作者
您好,我最近学习版图也碰到不少问题,想向工作过的人请教。
0 v; \" @2 q) l5 d8 X延着哪个问题1 C6 c6 q( ^- M& T
CB  CBD UBM RPO NTN PLMIDE FUSE DNW VTMP VTMN RHI分别是什么层。4 g8 _% \) H: R% |4 i
一直没搞明白。希望能不吝赐教。
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