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Chip123 科技應用創新平台»論壇 › Chip1 -- 基礎元件 › Layout設計討論區 › layout 設計風格之討論！
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layout 設計風格之討論！

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alai
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1#
發表於 2008-12-11 14:45:38 | 只看該作者 回帖獎勵 |正序瀏覽 |閱讀模式
layout人員拿到一個電路以後，應該如何布局電路呢（我只指一個模塊）5 I6 q8 f: O/ g: \3 R% \

) r7 O3 Q6 I8 Y! G( j4 u我喜歡把PMOS和NMOS各放一排，PMOS放在上面，而NMOS放在下面。電源和和底線呈上下平行走線。這樣似乎比較浪費面積。匹配管子比較偏好交叉二維匹配。
8 s( S! P% q5 d) q9 }1 ^* Z6 |% v( p! {7 T
各位大大，你們是怎么布局的呢？
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ychchip
20#
發表於 2009-7-20 15:19:10 | 只看該作者
如IC過大, 需與其他人共同合作的話, "界面"與訊號可能要先定義清楚較佳.
* Q6 T/ y: P% f1 y確實, analog layout 不能清一色要求面積小, sensitive path, cross talk, match, and isolation 要優先考慮...
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19#
發表於 2009-7-20 12:02:33 | 只看該作者
我是會先看整各TOP電路的關連， 想POWER LINE 要怎樣走，接著跟六樓樓主差不多，也事先把一些 current mirror 或是需要common centroid 的MOS 先畫，燃後在慢慢擺上一些比較不需要注意對稱或是偏數位的電路上去，先考量效應跟連接的關係再考慮面積(類比電路)，
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18#
發表於 2009-4-23 22:17:10 | 只看該作者
贊同六樓大大所言
2 z1 C" T5 I: z, a4 Y
, s( t0 c- O& o- M) L' Lanalog ic，我習慣先lay 重要的mos（p/n），接著擺重要mos上面或下面的current mirror，最後再擺switch mos或logic gate。一邊擺一邊想訊號怎麼走，power路徑等等。當然最後都會是一個很漂亮的方形。
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17#
發表於 2009-4-23 15:09:19 | 只看該作者
會先了解POWER LINE的路徑走向為何$ z. ?, }( T' F  N3 [: Y" D
再來擺放MOS即接線/ p3 o- _  Z, l; ~3 l
或許有些籠統
: f8 Z0 T# F3 U5 {) W8 Z. l7 V) @因為我LAY的是DIGITAL9 w6 S, u4 d0 q% M# _' l
所以了~~~盡量壓空間就是了
7 {0 K( v6 y6 ?) J當然最後還是要成矩形
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siting
16#
發表於 2009-3-5 10:55:46 | 只看該作者
真是好觀念
9 d+ s. A$ K, q& g% M先劃重要的mos再劃current mirror其他留最後
- k& {6 `$ Y: V* z, i$ o不過通常結果大概都是pmos在一起,nmos在一起
" F# Y( j0 i' u5 M; B所以我以前總會有analog layout與digital layout plane
( G  B1 z+ ^+ n2 h很像的感覺,現在離清它們不同之處了
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15#
發表於 2009-3-5 09:41:09 | 只看該作者
学会合理布局才算是入门，要知道自己为什么这么布局，好处在哪，还有什么要改进的地方，能说出一二三来，就算有进步了
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14#
發表於 2009-2-11 15:36:57 | 只看該作者
看電路的複雜度 先做好floor plan 儘量做成方型 才是 layout 王道呀!!
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ling06
13#
發表於 2009-2-9 17:01:50 | 只看該作者
是啊,我进入Layout行业也快一年了,感觉自己进步的很小,每次看到人家的布局,就感觉自己画的太刺了.
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12#
發表於 2009-2-3 16:11:18 | 只看該作者
多做项目才行！多看产品也行
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extrc
11#
發表於 2009-2-3 15:20:32 | 只看該作者
謝謝6樓大大這麼好的見解。
* M$ h& r4 [& Y- K; q7 c$ T進layout界快滿2年，總覺得自己還是原地踏步…
, X9 e. N8 W; Q+ l) Y有時想起來挺慌的。
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10#
發表於 2008-12-29 17:38:14 | 只看該作者

回復 6# 的帖子

完全同意... & F4 U3 t$ Z0 H2 I* N* r
還有我會留意所有的well, diffusion 是不是足夠,而且最好是矩形
( X4 \$ [% B' V% S+ ?再看看metal 上的via 是不是足夠,多加一點可以對yield 有點幫助
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9#
發表於 2008-12-26 20:11:25 | 只看該作者

感恩

贊哦∼8 h- d# m( u* A3 f+ l  Z( {
感覺真是收穫良多
" g  l0 s7 n7 R9 j+ n謝謝各位大大無私的奉獻贊哦∼8 _& V$ i( u) R! I2 K) A1 j: n( }
感覺真是收穫良多$ [3 A. T: K+ _0 E
謝謝各位大大無私的奉獻
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alai
8#
 樓主| 發表於 2008-12-25 12:52:22 | 只看該作者

回復 6# 的帖子

有段时间就这个问题有点困惑，6楼兄弟给我了点启发！不错。
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7#
發表於 2008-12-24 20:37:26 | 只看該作者

回復 6# 的帖子

,很不错！
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小包
6#
發表於 2008-12-24 17:23:02 | 只看該作者
我lay的是analog ic，我習慣先lay 重要的mos（p/n），接著擺重要mos上面或下面的current mirror，最後再擺switch mos或logic gate。一邊擺一邊想訊號怎麼走，power路徑等等。當然最後都會是一個很漂亮的方形。
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hlbecky
5#
發表於 2008-12-18 12:43:39 | 只看該作者
我觉得Digital和Analog差别还是比较大的！
) |% }4 ?4 ~. {) B5 C" x0 BDigital主要是size方面比较优先考虑
1 y& U! }) E# K# Y) J. n, E( }& w0 o6 R! ?
Analog主要是性能和匹配方面要优先考虑
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alai
4#
 樓主| 發表於 2008-12-18 10:48:16 | 只看該作者
咋都沒有人討論？？？？？？？？？？？？？
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3#
發表於 2008-12-17 19:41:47 | 只看該作者

回復 1# 的帖子

應該先看看是類比電路還是數位電路吧?9 H2 O- b0 _* c( D: e: Z

' V7 Q/ C% Y! E6 B9 V如果是邏輯電路 PMOS NMOS分別放上下兩排) {% E$ T$ ^, r1 S
這我也是這樣做
$ c  V/ |0 p7 h( Q( H! m2 j% B' k
3 i0 {* h# W# B類比電路就不一定了
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alai
2#
 樓主| 發表於 2008-12-11 14:47:34 | 只看該作者
請大家說說自己的風格。討論各種方法的優缺點。
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