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[問題求助] Transient 與 DC 模擬結果不一致,是哪邊出問題?

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1#
發表於 2008-8-13 21:17:31 | 只看該作者 回帖獎勵 |正序瀏覽 |閱讀模式
我在設計一個 Bias circuit, 電路示意如圖所示。9 u+ }: E3 T# U: s$ t  W  Z+ e" o
+ _) L" y) |% I- ?% R; T0 w$ Z

: `' [. ?8 s; z5 K" z, h* V1 |6 MIref 為 bandgap reference 產生,我希望 Vo 的電壓為1.35v左右。7 ^0 q; U) _* E4 H
# a! H2 @5 A, S# D; p' q
我在 DC 模擬時,Vo 可得到正確的電壓。 但在跑 Transient 時,Vo 大約為 0.75v 而已
( D  K! D; k& J
. f' |* _3 O# k$ _1 OBandgap reference 已加 Start-up, 由模擬時可看到 Vref 已被拉起到 1.0v,
+ x: @" G$ U1 K, `: v此時,電流也產生出來了。
! e* K) s5 p- `, \( B& ~5 t( T4 Q: n) I3 f8 i
但 Vo 的電壓就是與 DC 模擬時不一致,不知道是哪邊出問題 ...  百思不得其解啊∼

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5#
發表於 2008-9-22 13:45:18 | 只看該作者

回復 1# 的帖子

Bias circuit要輸出1.35V,可以加大m3 的length,讓m3的Vgs變大到1.35V, / y% r3 ^6 e& N4 c" m4 |
在接出去
4#
發表於 2008-9-20 22:56:51 | 只看該作者
這樣的設計VO容易隨製程變化而飄動, 因為M4 與M7上的電流決定了VO值,
" ]' [2 f+ K  {. N& X. b9 V- f, u但是此電流在這樣設計下卻是不容易穩定, tran. 模擬通常應該比較接近實際情形- o7 Y* m- `' u  U- j& z: Q
(如果條件設的好的話)
3#
發表於 2008-9-8 11:55:09 | 只看該作者
這樣的設計不好
* v8 [" l1 v# s9 A/ i5 `4 g4 z利用兩顆MOS的Vds來做偏壓是很容易因製程關係而跑掉的~~~" ~( Q& I  s0 L/ X- Q% I% s- E$ a( T

6 S. f, a! B; \3 @7 Htran與DC的收斂會不同,導致Vo的差異會很大
/ T/ x6 x0 |0 O3 W( O8 D+ ?
5 Z% E. ~, w2 d( ~' `8 j4 G& y[ 本帖最後由 li202 於 2008-9-8 11:56 AM 編輯 ]
2#
發表於 2008-8-14 13:20:13 | 只看該作者
你在跑Transient時,Iref的電流是否正常,因為有出來並不一定等於電流等於你在跑DC時所設的電流值6 R& n* P" D! d
另外,你 Transient的時間設多少,會否電路還沒有穩定,把 Transient 時間拉長再看看

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shaq + 3 原來是我太猴急了....時間拉長一點就看的到

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