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為什麼MOS上的SOURCE要接到BULK

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1#
發表於 2008-3-30 18:28:39 | 只看該作者 回帖獎勵 |正序瀏覽 |閱讀模式
BULK與SOURCE端相接的原因除了避免LATCH-UP,另一個就是* r+ r9 K, X! ]4 T3 y2 ^
避免BODY EFFECT 也就是基底效應,如果你有讀過VLSI的書不難0 w: m* G& D: j4 s
了解SOURCE跟DRAIN的導通必須透過"空乏區",空乏區的產生必
+ J6 {) A3 Y, y, E, ]% k7 N須透過從GATE端輸入的電壓,當輸入的電壓大於臨界電壓時空乏區
6 y* M+ h) n' _2 x/ M0 i才會產生,臨界電壓與SOURCE端的電壓有密切的關係,如果沒記' y9 T) Q8 N3 d& A
錯GATE電壓+SOURCE電壓等於臨界電壓,如果SOURCE端電壓
2 N5 ^$ [+ W% U6 g7 M. m不等於0,將會造成打開空乏區的電壓必定需要增大,相對這種情況
& b/ O! Q. N" h下的MOS就不易被導通,而且增加了電壓上的損耗。
* H) D  C6 H( i  ^: L
+ u. ^7 t* {& S! r* E如果有寫錯還請各位指正,謝謝。
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5#
發表於 2008-4-1 07:29:14 | 只看該作者
讀了一遍  覺得文中所稱的  空乏區  應該是 反轉區吧  (Inversion Layer)& @' K* _* C" w/ k( s. z: W
我的認知是覺得  Body effect  就是 VBS=0   NMOS就是 source與bulk 要接到 GND
, a! @- h: Q7 j& C9 |- V" uPMOS 就是 source與bulk要接到 VDD  [0 S9 F% c) b' {4 g
但是電路上還是會有 VBS不等於0的情況; H6 r% }4 F8 k$ I4 H! L
這通常發生在  MOS串接的情況   不管是 Cascode還是 CMOS邏輯 串聯的那一塊
6 K8 P- ]1 T9 y- C3 V2 A$ Z# N+ M都無可避免的有 基底效應出現,  所以一般來說 我們做 CMOS互補邏輯  最多就是用到 4-Input : }) J8 L; z* @' B) @4 _9 c6 i% k
因為太多輸入時   串聯的MOS間會有  Chrge sharing的問題, 其次就是疊越高的MOS Body effect會越嚴重
: Y1 G& u6 W7 e7 d) I$ D$ E最後一個Issue是   該邏輯拉到 1或0 其中一邊的速度會變成非常慢.6 t6 j9 B) J0 N% k' q. a( Z+ q# F
Cascode最多就是疊兩個   疊太多會傷到  OP ICMR 或 Output swing.( B. z! V/ [$ f/ t6 e
  w7 J: N$ |, w& j0 [3 T
[ 本帖最後由 yhchang 於 2008-4-1 07:30 AM 編輯 ]
4#
發表於 2008-4-1 00:18:14 | 只看該作者
Seems it depends on application, Vt vary with Vsb. Mostly if we want to have min. Vt, source is connected to bulk.
3#
發表於 2008-3-30 19:31:01 | 只看該作者

回復 1# 的帖子

應該是Vgs>Vt也就是說Vg-Vs>Vt........................................
2#
發表於 2008-3-30 19:15:40 | 只看該作者
以 PMOS 而言, Body 可接到 S 或 VDD. ( p  G2 Z( w' ]
都是為了保持 Body 對 Channel 的逆偏。
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