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為什麼MOS上的SOURCE要接到BULK

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1#
發表於 2008-3-30 18:28:39 | 只看該作者 回帖獎勵 |正序瀏覽 |閱讀模式
BULK與SOURCE端相接的原因除了避免LATCH-UP,另一個就是
7 E$ i) c; t$ j( l& G  E1 ~避免BODY EFFECT 也就是基底效應,如果你有讀過VLSI的書不難
5 s8 r" ]- G% P6 ]* T: C9 W$ k了解SOURCE跟DRAIN的導通必須透過"空乏區",空乏區的產生必' X) _7 ?& c- k
須透過從GATE端輸入的電壓,當輸入的電壓大於臨界電壓時空乏區
, l0 ^, Y6 [% e/ L6 |, H5 O+ r+ |2 s才會產生,臨界電壓與SOURCE端的電壓有密切的關係,如果沒記
4 P  {9 g+ q* c* a  Z- i錯GATE電壓+SOURCE電壓等於臨界電壓,如果SOURCE端電壓+ E, e- z. ~. g  P; G1 j
不等於0,將會造成打開空乏區的電壓必定需要增大,相對這種情況4 Z2 L7 ?* d, o) K. a0 b0 ~) x5 d
下的MOS就不易被導通,而且增加了電壓上的損耗。3 l5 d& w. [) {/ w6 D2 I6 m
2 |& J4 U+ b4 o, P( i: A. F; f
如果有寫錯還請各位指正,謝謝。
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5#
發表於 2008-4-1 07:29:14 | 只看該作者
讀了一遍  覺得文中所稱的  空乏區  應該是 反轉區吧  (Inversion Layer)
' f2 m, M# l/ g6 U% y我的認知是覺得  Body effect  就是 VBS=0   NMOS就是 source與bulk 要接到 GND: h  P( m5 b- J# v* U. Q/ ^
PMOS 就是 source與bulk要接到 VDD0 T1 g# N. u" W, h- [9 u5 `% {
但是電路上還是會有 VBS不等於0的情況& m  T* g- j6 T) Q2 ^; o
這通常發生在  MOS串接的情況   不管是 Cascode還是 CMOS邏輯 串聯的那一塊% v! N7 A* f: l1 ^. _0 t
都無可避免的有 基底效應出現,  所以一般來說 我們做 CMOS互補邏輯  最多就是用到 4-Input
( K7 S% c! H1 h& v  g5 v) b5 u- @因為太多輸入時   串聯的MOS間會有  Chrge sharing的問題, 其次就是疊越高的MOS Body effect會越嚴重4 ]! K* x2 U7 ?& }6 E
最後一個Issue是   該邏輯拉到 1或0 其中一邊的速度會變成非常慢.: \' `0 K6 e) r
Cascode最多就是疊兩個   疊太多會傷到  OP ICMR 或 Output swing.6 k/ e! r2 x! C- K0 W. V

4 }3 @% u  O5 S4 Q' R# v[ 本帖最後由 yhchang 於 2008-4-1 07:30 AM 編輯 ]
4#
發表於 2008-4-1 00:18:14 | 只看該作者
Seems it depends on application, Vt vary with Vsb. Mostly if we want to have min. Vt, source is connected to bulk.
3#
發表於 2008-3-30 19:31:01 | 只看該作者

回復 1# 的帖子

應該是Vgs>Vt也就是說Vg-Vs>Vt........................................
2#
發表於 2008-3-30 19:15:40 | 只看該作者
以 PMOS 而言, Body 可接到 S 或 VDD. ( G# Y) g/ E; X. A" y6 g% G/ `* D
都是為了保持 Body 對 Channel 的逆偏。
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