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Chip123 科技應用創新平台»論壇 › Chip1 -- 基礎元件 › Layout設計討論區 › CALIBRE LVS & DRC
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CALIBRE LVS & DRC

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1#
發表於 2008-3-5 17:33:06 | 只看該作者 回帖獎勵 |正序瀏覽 |閱讀模式
請問一下有誰大概可以跟我描述一下 LVS 跟 DRC 一些基本的概念!!1 _+ K1 U$ E0 g0 R, o8 I: s
- G2 d3 ~& j  C' s0 C/ I
比如說怎麼去認一個NET DRC怎麼比對的呢? 比較內部的分析0 \! O  Q2 f+ t& W2 f

: ?( ?& n1 z9 R; p謝謝分享...
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188
12#
發表於 2020-8-16 11:08:17 | 只看該作者
大的解釋真好~~~小弟了解囉~~多謝唷~~多謝你的無私~~謝謝
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11#
發表於 2008-7-30 21:38:23 | 只看該作者
請問一下大大們
* b5 i8 a+ V0 Y9 K5 O要跑lvs時9 e8 I4 k: \7 a/ c
要產生.sp檔一直發生錯誤8 N3 z$ b: ]) J, `% M; B0 T2 ~
沒辦法成功! g: p$ C, c8 M: B3 S
請問是甚麼問題阿
% ?. J+ c! m( {) y*************
4 [# F8 S; u' t5 a# v* h6 e# D
0 Q  B' `0 K0 b% D$ G; b不管執行什麼程式,都會記錄在紀錄檔裡，例如： *.log,
* S, L$ O( @; \& U% I你先開 *.log 看看是什麼原因？! h7 I7 Q4 Y" c
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10#
發表於 2008-7-30 20:15:50 | 只看該作者
請問一下大大們
; o- a1 H' e. I9 |$ ]9 {要跑lvs時
  ?) \+ W. a7 r  L2 _! D: C) M6 K要產生.sp檔一直發生錯誤
, u4 r1 j- w5 n4 e& y0 j$ a沒辦法成功/ w) X- D; g- T
請問是甚麼問題阿' G* ?& p8 v5 q9 z
*************
6 m% n* O# }- R: P, R& `4 Z/ j可以將問題敘述更詳細一點嗎?
( ~2 k9 h- o( V2 U: m4 J這樣才可以確切的解決大大的困擾~
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9#
發表於 2008-7-24 00:18:11 | 只看該作者
我看我看我看看看
3 ]4 k: ?$ t, d- c$ U7 ?: D& \我看我看我看看看2 O0 W& O' W/ C3 |3 o5 I  e
我看我看我看看看
' c6 e  \' ?5 [3 L) }! P我看我看我看看看1 u8 r: n7 ]" m! A
我看我看我看看看
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oligxoi
8#
發表於 2008-4-28 09:42:49 | 只看該作者

回復 7# 的帖子

請問一下大大們- H. M. y( {: u0 Z
要跑lvs時
. ^/ Q  z: T/ @; t( ]7 ]) t要產生.sp檔一直發生錯誤/ o7 u0 k6 K8 |3 s9 z
沒辦法成功
/ A- W# p5 |/ C+ U+ |1 g請問是甚麼問題阿
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ricky000
7#
發表於 2008-4-25 03:03:52 | 只看該作者
我看我看我看看看' H: D+ H! M* k) f0 C
我看我看我看看看9 H, w, B0 M# t+ F& J1 v7 B9 F
我看我看我看看看; T! d/ b3 `9 b% e6 J( S- o
我看我看我看看看* j+ e( q$ W* x( i5 ~
我看我看我看看看
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6#
發表於 2008-3-13 22:26:06 | 只看該作者
大大的解釋真好~~~小弟了解囉~~多謝唷~~多謝你的無私~~謝謝
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x014067
5#
發表於 2008-3-10 17:05:44 | 只看該作者
學了一年多，現在才在這裡看到原來是這樣的縮寫，以前都只會用，但不知道有這樣的意義所在，真是受益良多阿!!
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4#
發表於 2008-3-7 08:53:44 | 只看該作者
簡單的說~你要的答案可以在LVS & DRC 的COMMAND裡找到* e5 x9 }1 |7 M, l

! a8 r9 g. l3 N) w$ W6 x4 P& C$ yLVS的原理就跟之前所說的一樣，CALIBRE 如何去認到MOS 除了COMMAND外
- _" C4 g) p! U" s" }你還必須STREAM IN SPICE ，COMMAND裡會去定義怎樣的條件下他是PMOS
  E4 I% X! J) d- N. a還是NMOS，如何判定是INV是去比對你所STREAM IN 的SPICE ，在LAYOUT中
$ h* L& N4 r! w如果有PMOS 跟NMOS的連接方式跟SPICE中的定義相同那LAYOUT就是INV，至
4 _3 c; R4 Y5 c' ?於如何找到特定的NET，除非在電路中就事先寫入，不然在CALIBRE RUN LVS時
0 p7 l2 b" y/ I: i: K9 l  J所產生的NET NAME是隨機排序的，不過有些LAYOUT的TOOL有辦法認到NET，0 j. G) ^: g9 H* ?' r
但也是必須事先設定。. \* ^# f( B& ^' e, l+ j4 X

; |  V# x- y$ O# S) }DRC的原也跟之前說的一樣，COMMAND FILE 會去依DESIGN RUN 裡的規則然8 |  i( q, P2 ~& z) ?( M3 n
後寫出一連串的句子，將所有層的可能的相對關係以條件式的方式寫入，然後再2 c9 j4 {0 z: {: j+ Y% {
利用TOOL 去比對並將結果顯示。
0 E& t( J9 v- J) C
; G( k7 R! ]* g& W1 f$ W以上是我所了解的部份，希望有幫你解答到。
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3#
 樓主| 發表於 2008-3-6 18:30:07 | 只看該作者
喔 不好意思 我沒有逗號逗開 我的意思是說 lvs 是用什麼樣的原理去比對... 他樣去認出一顆mos 或是 inv 呢??
' I) i. k3 w% `$ V$ D4 q2 d9 E" S( E) N# k- ~$ g
那他怎麼去認出 那根NET 要跟哪個NET相接 SPICE上寫的NET 他怎麼去判斷的呢!?4 v; S1 t, H1 v; J( w

& Z% V: v2 D0 c& o4 [3 }是這個意思拉...DRC也是  他比對DRC時 是怎樣比對 一層一層 或是用座標 之類的 相關資訊 ^^9 M+ R! V% f% s% A* |( l- A# c7 Z

  B- `) e* ]' ~/ b謝謝你
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2#
發表於 2008-3-6 17:35:09 | 只看該作者
極簡單的說DRC 就是Design Rule Check 的縮寫，也就是依照Design Rule來check你畫的layout5 S7 Q. D7 x6 y: `! G$ R) L! y
只要將check 出來的error部份修除就ok了
; P) E' F) J  n: F. {2 H2 ?8 A4 `7 W5 Z" X4 K$ t3 G3 S$ @- X8 G2 n
極簡單的說LVS 就是Layout vs Schematic 意思就是layout跟電路的比對
/ u/ `. u# Y* w5 Y1 b" t7 X5 w除了比對電路有沒有接錯還會比對model有沒有畫錯。- p8 Z  R9 L  v  D* D$ J( J
+ P- o6 D8 W0 d2 q  `  p
另外請問您的問題NET DRC 是什麼意思?因為沒看過所以沒辦法給你解答。
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