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[問題求助] T18 DRC LUP3.1g_1.8V

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1#
發表於 2013-10-7 23:48:56 | 只看該作者 回帖獎勵 |正序瀏覽 |閱讀模式
本帖最後由 aj002547 於 2013-10-7 11:51 PM 編輯
8 K$ a/ J4 E! x; x$ B- M6 L& p+ O% Q3 x" i: A- A
各位先進好, 小弟有遇到一DRC錯誤不只如何解, 想請教各位
  j9 \8 O; k- Q3 y: H, R# p
8 ^% r& F0 M8 b圖片的反向器輸出有接至PAD, 但cell都是畫好的,
. M8 n& Y. N$ F1 Y! j$ F: a& F! j, C1 z
難不成真的要把這塊拆開然後拉開到他所指的3um這麼長距離嗎?5 x7 S8 ^7 o, }  ]
& P( f/ f/ h. F* ~9 r# j
還請各位先進有處理過的幫忙, 謝謝
# G" T9 W1 [3 v; X% Q6 X  K
7 G' \& K, L# b/ F7 g# O+ o% i9 C3 R9 e9 W: h: B4 Y0 b

- d0 L% @4 X; m" [8 ]( `3 D* O* S
9 e( q4 A) H" P2 `& }highline處為紅色框起部分% T7 C/ s6 h, r- j

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推薦
發表於 2013-11-8 07:39:24 | 只看該作者
您好:
/ h- n. c# s! w, }* {2 |+ Z: g7 r% A
9 k2 p' c  u; U3 S       我簡單的按照DRC RULE上的字義跟分享一下我的看法,應該是說如果你的N/PMOS有直接接到PAD的話,你的NMOS就必須要圍上DNW,而且DNW跟你的PMOS的NW必須距離3um以上。
$ l. r3 G# D. \
7 `5 L8 ?6 k. m4 R/ z: V- q7 _$ T        我猜這應該是為了ESD所設的RULE,因為在PAD附近較易有大電流,故拉開N/PMOS以防止LATCH UP產生。5 y/ y7 t& i4 m
9 g. @/ U. z* L; h* R# ?$ J
以上希望對你有幫助。
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4#
發表於 2014-5-21 19:14:49 | 只看該作者
請把PNMOS 拉開 並為一個完整的ring
3#
發表於 2014-5-21 18:14:38 | 只看該作者
LUP  廠 rule; P5 A1 E( a) B9 }8 j5 C
0 }' D& Z, d/ g6 z, G+ r
space  between the NMOS and the PMOS
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