關於偏壓電路

adamsnet

小弟想請問是有關於op bias的電路
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4 T1 z( Z- x: P+ Q; R各位前輩有什麼訣竅嘛?
. O( X0 K8 |$ n) a* J) Z- G. \  l0 E
畢竟很多偏壓電路 一開始不知道想採用哪一種
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9 B2 @+ G" A9 H! T! B能請各位推薦書(最好是有說設計的步驟)或是一些起手的想法
! {: ^7 K$ c+ p3 B9 I! P" n
* P1 n$ u# Z( S$ j2 @小弟我不想只照著學長的例子直接拿來用
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9 G  g; g+ }: A8 |8 n8 Y因為感覺那不會成為自己的東西!!
) s' ?3 L; f8 k/ v* A4 _
感謝~

game750219

建議你去看CMOS Circuit Design - Layout and Simulation  R. Baker 這本書的23章
* Y3 f% `) V) d4 i2 z
裡面有幾個基本偏壓電路

" z0 X2 }4 e$ n. T6 p也許對你有幫助

shangyi

你應該先搞清楚 "pmos最上面那個的gate拉到下面一個pmos的drain" 跟 "拉到最下面pmos的drain"
) ]- s  N0 ]8 f& `% A的差異跟目的是什麼?
$ M8 m+ V! Y, q- M  E還有你的OP疊接這麼多MOS的目的是什麼? 需要六個偏壓點?
op操作電壓範圍是多少? 此op有什麼特殊應用?
上面的東西可以在上面的人所推薦的書上找到.
bias 電路是廣泛使用的電路. 你想要創造新的架構 ...又有很好的特性...很難
0 b9 n% Y+ L; b' t) ?& Y" x一開始採用書上基本的就好  若不符合你的應用.. 再去思考怎麼改善現有的架構

adamsnet

感謝大家!!!
基本上樓上各位前輩說的各種特性我都知道
8 Y3 E/ G; L% G5 w" P  a只是要如何把它切確的轉化成電路
2 Z$ Y; w2 L* B7 X1 {( L- z我的意思是
  r2 q; a5 R# E* t4 B假設今天我op共有7個mos疊接(3個p 4個nmos)
/ n- ]# a* q( c" F/ U8 P那bias電路應該也有6個不同的電壓準位出來對吧?
(對應到同level的mos的gate端 扣掉input的mos)
那bias電路中應該有三個pmmos
一定都是pmos最上面那個的gate拉到下面一個pmos的drain嗎
! [1 u# y  p, g) a5 |6 ?還是會拉到最下面pmos的drain(等於橫跨過中間那個)?~
像是此種架構性的問題~
非常感謝各位前輩喔!

finster

目前最常見的是constant gm以及wide swing bias這兩種方式
1 r% k7 O) I2 E然後再搭配start-up的電路
另外,偏壓電路一般是提供偏壓或者電流,如果是電流,那會比較在意psrr和溫度
若是電壓,那需留意搭配偏壓電路的其他電路的size與matching,如OP Amp,如果OP Amp的size和偏壓電路的mirror元件size沒有等比例調整的話,那偏壓電路或者OP Amp即使設計的在好也是枉然,因為在一些power supply, temperature, and process變動下,整個performance就會漂掉,而這也是極為重要之處

vjc5

一般OP BIAS必須有抗電源擾動, 與不受溫度變化
教科書有很多這樣的電路.

jackrabbit

您這問題, 還真讓人不知該從何答起
建議先看一些analog design的教科書吧!!
3 H- f/ L' t, zAllen那本講OP講得挺仔細的, Razavi則是必K, 有餘力再看Paul Grey, Martin, Baker, Sansen的教科書
多看幾本, 看每個人不同的解釋方法, 能幫助融會貫通!
簡單說bias電路是用來設定電路的操作點(operating point)~