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[問題求助] latch up

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1#
發表於 2010-10-27 17:11:25 | 只看該作者 回帖獎勵 |正序瀏覽 |閱讀模式
我想請問各位大大,8 X5 Y) G5 ^) g/ c( ?
在LAYOUT時會做哪些技巧來防止latch up發生??
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70#
發表於 2021-8-23 17:05:15 | 只看該作者
0 o/ e( z* M! Y6 K% G8 @7 T! P/ A
權限不夠看不到 ! * E3 Z' n" i0 a# }! c6 r
來鑽積分
69#
發表於 2021-6-28 10:16:29 | 只看該作者
以layout來說,guard ring圍好圍滿,PNMOS距離拉開
68#
發表於 2021-6-5 11:59:06 | 只看該作者
權限不夠看不到 來鑽積分
67#
發表於 2021-6-3 23:51:40 | 只看該作者
: v# F6 F& b8 [7 ?
權限不夠看不到 來鑽積分
66#
發表於 2021-3-21 12:25:07 | 只看該作者
" Z# ?. @. l8 g
權限不夠看不到 !
: l8 I2 P$ a3 c3 G來鑽積分
65#
發表於 2021-3-16 12:55:24 | 只看該作者
- V3 d' z/ W- W0 J3 n
權限不夠看不到
5 W8 s" S* Z; \來鑽積分
64#
發表於 2015-3-24 18:54:10 | 只看該作者
好想看無奈權限不夠5 Q6 B6 D9 ]; W5 J; A2 J) K3 ~# J9 G
謝謝分享
; h1 I3 h8 C* ?; g6 z
63#
發表於 2015-3-13 14:53:35 | 只看該作者
權限不夠看不到 !
0 ]/ d$ G7 \( n# W來鑽積分
# N2 ?" e9 T! |
62#
發表於 2014-12-4 01:55:50 | 只看該作者
權限不夠
5 B% T  ^/ [) l好想知道內容QQ
61#
發表於 2014-11-2 13:15:22 | 只看該作者
權限不夠高
% R" H/ @% B1 g* n  m! h鬱悶QQ
/ V. Q. V0 `: ]& Z9 \. z% A好想看喔
60#
發表於 2014-10-5 00:04:52 | 只看該作者
太好了,感謝大大解惑壓' z6 }4 T5 F( ~9 W: Z& `8 R- W- b3 |
感恩~~~
59#
發表於 2014-7-25 15:52:24 | 只看該作者
也很想知道除了這兩種方法以外, 還有其它作法可以降低寄生電阻嗎?
58#
發表於 2014-6-27 09:24:45 | 只看該作者
希望可以看到除了加ground ring 及拉開距離之外的方式
57#
發表於 2013-3-21 08:14:42 | 只看該作者
遺憾,權現不足。1 R' |9 Q8 ~8 }
但也從先進的回應中,學到一些東西,謝謝。
/ R% F9 |( G" Z" t' H# \9 E; Y# m5 d
/ r. O8 k% J* `) R2 w% Q4 X小弟是初學,也許提出很笨的疑問,但還是想請教先進們:; \% x( i: {" c! t
6 h, z5 d" h7 n
說然說拉開距離是依照自己的需求來決定,不過不知道先進們拉開距離覺得如何最洽當?/ ]/ m' h4 s& i* d
是越開越好嗎?小弟猜測應該是有個極限距離吧。
56#
發表於 2013-3-19 15:51:26 | 只看該作者
積分不足看不到......
4 T/ R# {; a4 Y" m* Q/ c) v9 b不過還是感謝大大的提供
55#
發表於 2013-1-2 10:32:11 | 只看該作者
才二兵看不到內容) Y( i  z1 n0 V) M1 z
先謝謝提供連結點的大大
54#
發表於 2012-10-24 00:46:03 | 只看該作者
不清楚一些部分
# Q$ P* n) I0 p1 Z5 h1 C& Y- E如果我是LAY OP第一級  是否要考量LATCHUP 問題
, O5 m8 J* p4 F5 W7 v
$ J. u  H( `! ?) H. z而把PN MOS距離拉遠  這樣缺點是會使訊號線拉長照成MIS MATCH機會上升6 g, C2 G- n4 f- L+ D  S
, B! F  }: T7 O5 Y: u8 d6 k
如果mismatch 為首要考量的話,我應該怎模作呢??
53#
發表於 2012-10-20 14:39:08 | 只看該作者
都讲得挺好啊,不过都在重复哦!!!!!!
52#
發表於 2012-10-15 16:40:51 | 只看該作者
权限受限
: z: m! a0 ^2 v& Y/ K# e! ?5 O% U不过无法阅读的可以参考the art of analog layout,现在的fab都提供latch up防范的方法,同种工艺基本上都一样  S5 P# y* u9 C0 k) O+ @6 `5 Y1 f( Y
我的理解是,先要理解为什么会发生latchup,之后怎么做就清楚了
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