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[問題求助] loop filter 還是vco

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1#
發表於 2009-7-20 12:37:00 | 只看該作者 回帖獎勵 |正序瀏覽 |閱讀模式
小弟最近遇到這樣的問題0 p+ Z  Z# v4 a# [3 c% a/ \5 S- [
就是把charge pump 加上filter 接到vco後' H" T3 I2 P( K
照理來說會是一個正常充放電的形式
+ M6 A  v2 V8 ]但我接到了之後卻出現了下圖
3 N( U6 s4 F5 G8 N; x: z反而變成震盪的樣子  有沒有大大能夠幫我回答一下呢  麻煩了
" q+ k3 U! P& j! ]: q; m2 N, Q5 R我測試過divider加PFD和CP都正常  所以我本身是懷疑VCO的問題8 Y7 o: a# j  {
但卻沒辦法解釋為什麼
# |5 k9 m; D; A* X0 `/ ?

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11#
 樓主| 發表於 2009-7-23 14:21:55 | 只看該作者
請問跟initial condition有關係嗎   我之前沒設是這種圖形
1 M0 M3 Z* a0 T把他訂在0.9V之後就會先放電  然後在慢慢的充電  就正常了@@
10#
發表於 2009-7-23 13:14:32 | 只看該作者
我記得好像是二階濾波器中的兩個
5 {1 j, ]/ Q1 A電容大小差得夠大,就可以用一階
- T  q$ Z' z) t  r& ]1 ?! F所推導的damping factor式子近似
3 e# L& p. u. i* u, \好像差20倍??這我有點忘了.....
9 d% r& E$ U6 f/ w不知這樣對嗎??
9#
 樓主| 發表於 2009-7-23 11:54:38 | 只看該作者
恩恩  我在調一下參數值
+ P! B5 a& z0 d. M如果還有問題的話還要再請教各位高手^^
8#
發表於 2009-7-23 07:53:04 | 只看該作者
你的damping factor太小了
. J9 i' [7 A- ^/ c在Razavi所寫的"Design of analog cmos integrated circuits"中就有明確說明damping factor應要大於0.707
) j+ h5 `2 b# O  ?+ ?故而以你目前所設計的damping factor來說,會振盪實屬正常9 C2 ^0 _! b% i/ M6 E
故而,建議你把LPF的電阻或者電容值增大/ e7 H% x7 b6 u/ a. i& r
另外,建議你設計PLL時,LPF要用二階會比較恰當,在Razavi一書中就有提到一階和二階的差異,一般都是用二階,己經很少人會用一階的LPF

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7#
 樓主| 發表於 2009-7-22 13:26:26 | 只看該作者
小弟想問一下  我看書上的damping ratio 和nature frequency 都是用一階的filter5 G  |$ \" C1 m9 r
因為我是使用二階的形式  那公式和一階的相同嗎  書上並沒有寫  冏. g/ \, K6 V, l2 W& z8 [
! Q) H. R- v$ D2 ?; R: L# ^
如果一樣的話算出來的damping ratio是小了點  大約才0.176: H% Z4 ?7 z$ b# X; z

0 N2 y" i" M+ S# {* ^[ 本帖最後由 laasong 於 2009-7-22 01:34 PM 編輯 ]
6#
發表於 2009-7-21 11:11:01 | 只看該作者
你的damping factor為多少??
# X# h' m. k% K* e: t感覺比較像是你的loop沒有stability,以致在跑整個PLL時會出現振盪情況# i& Z) N# ]# ~& m
建議你先計算一下你的PLL的各項參數
5#
 樓主| 發表於 2009-7-21 09:10:31 | 只看該作者
我把模擬時間拉長了  正在跑中
% ~, ^/ Q. O3 c8 H# Q想請問一下樓上的大大  沒加初態是什麼意思呢  麻煩解釋一下囉∼謝謝^^
4#
發表於 2009-7-20 21:12:49 | 只看該作者
是不是vco沒有加初態,記得以前我做vco時在這點上犯過錯誤。
) ]) P2 s) P; A% ?" w  q: x* u% `8 W" o
最好是先建模,然後再一個一個模塊用電路來實現,這樣就很快。
3#
發表於 2009-7-20 20:07:41 | 只看該作者
首先确保你的仿真时间足够;' |  a8 E4 |$ |$ r, L
如果还是出现此类问题,在你排除PFD,CP都能正常工作外,那只能是环路不能够稳定。
2#
發表於 2009-7-20 16:48:45 | 只看該作者
环路不稳定?
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