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成也蕭何, 敗也蕭何
在SOC production test的世界中, 設備使用的"彈性"也是降低持有成本的必要條件,
9 n! s4 W1 l* |5 W9 e愛德萬自原先專注的記憶體測試市場欲跨入SOC測試, 利用其Handler最大並列同測能
; p8 T1 ~- P/ ?7 k2 q9 D+ w/ s力(每次16個元件, 一般Memory Handler每次可測256個元件) 來提高效率並降低成本,
: R0 _# t: U3 @5 o) }, c- R1 p. h乍聽之下似乎超越現在的系統 (一般每次可測4個元件) 但是
* q0 j5 }' u. A1. 愛德萬的Handler並無法與其他廠牌測試機連接運作 (愛德萬不提供連線電氣規格), 設備投資彈性不足.) q! P7 K" a5 z1 _' z0 x; x
2. 愛德萬的Tester無法與其他廠牌Handler連接運作, 萬一產品封裝格式M4841不支援, 生意也別想接了.& w! i; M; V5 C# [1 ~0 s5 A
3. 大型SOC使用高腳數大尺寸IC封裝, Tester I/O數量頂多支援同時測試2~4個元件, Handler再強也無用武之地.' G8 V, I; y! {" @9 p ^% a6 j
% ?3 p3 _0 `. [0 i9 H& P換言之, 中型腳數(<=200pin) 之消費型IC, 應該是最能發揮該系統每次可測16個元件高效率的目標市場,9 R$ i) C) U' ?! Y" ~- B7 l7 |
但是per pin 500Mbps or 800Mbps的高貴I/O又超出該市場所需, 開發低價200Mbps的I/O模組及
5 E5 i& P0 r0 T, U" _高速3.6Gbps高速序列介面模組(for few LVDS/PCIe/SATA2/HDMI pins)才是符合市場發展的策略.
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另外該宣傳稿未見SOC測試常見支援Video AD/DA測試之14bit HF-AWG及Digitizer. Audio band的AWG8 B! p F/ {: t) `- H; y+ J
及Digitizer也不知resolution(18 or 24bit?)及noise floor (or SNR). 此外, 元件power supply channel數
! x! s3 R7 {2 r% h% C" s也是重點, 一般SOC的pad power與core power電壓不同, 再把analog power分離, 一個元件就需要至少: t& ^# u2 I3 S6 j! b9 A6 h% d& ~
3個分離電源, 測試機至少要能提供48~64個可程式分離電源, 才能達到宣傳的"一次可測16個元件".3 k. v7 ^9 G" e( y6 W! _: w
4 Q5 X; H [5 b1 x# M& Y6 w) k愛德萬T2000被Intel大量採用, 想必有過人之處, 但是台灣測試產業面對多變的環境及各種客戶, ' ^4 V0 M% H; D. `% U5 L
彈性與效率是同等重要, 既然名為Open, 真的多open一些連接規格反而比較容易活. |
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