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Chip123 科技應用創新平台»論壇 › Chip1 -- 基礎元件 › Analog/RFIC討論區 › 求助Peak detector設計
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[問題求助] 求助Peak detector設計

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發表於 2008-10-2 16:50:43 | 只看該作者 回帖獎勵 |倒序瀏覽 |閱讀模式
想請教板上各位前輩，小弟最近在設計用於VCO AAC電路的peak detector，採用的架構如附件，3 b$ q) ^0 T( h* V/ m( _3 _
但在模擬時遇到問題，我的輸出Vrmp並沒辦法trace我輸入的peak value
0 P' \) e3 g8 i. b0 H6 P
. j! [# j! |2 q! M. ?舉例來說我輸入Vp-p為1V的信號，但是輸出可能只有0.5V，若輸入Vp-p為1.2輸出可能變成0.55，% b" S+ V- O3 W9 ^
經過實驗，輸入輸出仍維持線性關係，但並無法真實的"偵測"輸入的peak值，想請問各位前輩在設計0 W+ I2 i4 ~+ H! F# {9 P: D# d: L9 y2 r
上有哪些需要注意嗎?

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