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[問題求助] 如何預估 spice netlist 的 area ?

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1#
發表於 2008-1-16 14:17:49 | 只看該作者 回帖獎勵 |倒序瀏覽 |閱讀模式
假設我有一個 spice netlist,
: v5 {0 b  v4 c% M- S請問有沒有可以預估這個 netlist 大致在 layout 完後area 大小的相關軟體. 或方法% z, N+ c* ~, `, ?! O$ c! s
謝謝大家
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2#
發表於 2008-1-16 14:33:14 | 只看該作者
看是數位的  還是  類比的!!2 y2 n9 ?) M9 Q6 Z
通常數位的比較好估,因為每一個 cell 都有 chip size,所以 total chip size 與你所使用的 cell 有關,所以可以估算。* |0 T/ L( W# Z$ I" _. g9 |" Z, [
類比部分  通常是概算吧!! 先 layout 一些 cell,然後就可以粗估了,拉線可能再乘以1~2倍吧!* w4 S% s5 r  z& ^6 r6 u4 G
最後再加上 ESD/ sealring 等相關的應用之面積。這些都是一個概念值!!
3#
發表於 2008-1-16 19:51:29 | 只看該作者
跑線的area若不算的話是可以寫program來預估
1 s# v1 L3 c7 P5 }8 o以一個10/0.5的device為例,
8 r/ F! V  S0 X; Vx = 10 (Width) + 1 (假使active to active spceing為1的話)=11
% R4 H6 `; X# g8 N4 m! [Y= 0.5(length) + 0.25(假使ploy to contact minimum rule=0.25的話)*2(有2邊) + 1(contact size)*2( 有2邊) + 1 (假使active to active spceing為1的話) =4
& _8 P) W! R9 h/ G5 _可得此MOS size為X*Y = 44 um^28 F1 y( K9 ~+ P7 o2 \
total area即為所有MOS的總和

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sjhor + 3 不錯的想法唷!!

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4#
發表於 2008-1-18 01:54:02 | 只看該作者
這算法看起來是直覺的方法,
4 k6 p) q5 F2 e# O( h與實際佈局面積仍有差距,! U! O* X0 ]$ S$ O+ Z
畢竟layout會用到很多技巧,4 [/ q, F" d2 q) e
如何降低估算面積與實際面積之間的誤差,
2 X- `* w+ t! \* a# e5 O7 k- ?3 `% w這應該是很多layout工程師的經驗吧!) P9 ^' n9 O7 O4 d
可惜教科書上也沒有講到很詳細的估算法則
5#
發表於 2008-10-18 14:14:16 | 只看該作者

大概是這樣

看這本書吧他有講簡單的如何估計2 C/ P) m7 B. z
Neil H.E. Weste and David Harris, CMOS VLSI Design: a Circuits and Systems Perspective, 3rd ed., Addison Wesley, 20058 R6 c; [6 J' Z  ]5 ?8 {, d
他大概有獎到一點
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