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[問題求助] MoM電容在LVS的錯誤

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發表於 2022-7-20 11:16:55 | 只看該作者 回帖獎勵 |倒序瀏覽 |閱讀模式
本帖最後由 wuhy 於 2022-7-20 11:18 AM 編輯 7 N; m! F7 }* Z% @; L

0 F/ |; E1 L9 i8 Y+ o: b各位好,小第剛進入Layout工作不久,最近在繪製M1~M4的MoM遇到LVS和schematic對不上的問題
$ A0 G4 g5 q' Q. e; S使用的製程是SMIC013,使用工具爲Laker/Calibre
7 f) d+ i" ~5 u  ^$ l* ?LVS錯誤如圖:h ttps://imgur.com/vnbjH5V
" t% @+ I1 ?2 o$ v, Y8 W; b$ F& b, q+ e
netlist如圖:h ttps://imgur.com/IF8qvhC9 ~; `- `" t2 ~: a
3 Y9 q& B" G2 n. j& H: y. E
layout如圖:ht tps://imgur.com/amp5eSM% C$ V6 ]) ~2 d& i9 Y

0 n5 C% E# Y/ n$ ?4 K
( {  J0 d% w/ b8 }- r- g, V我確定我有加上MoM的layer讓LVS去認
: E$ N$ e( B3 b5 I從LVS可以看到他有抓到MoM,且生成了mom14_ckt的子電路
/ s8 u8 y. I8 {' w! u1 J0 B- O但問題是LVS生成的layout spice內mom14_ckt是空的(我猜是based on名為empty_subckt.sp的檔案生成layout spice)
2 H. X3 |! Z, Z: C  r: t  Q  b" p所以LVS才會報錯
! I9 h# d0 R* {) d6 X
: o. X0 j0 v8 ~1 v* Q! m5 Q+ c. i: J我有看到有人在Calibre->Setup->Netlist Export Setup的Include File填入empty_subckt.sp的路徑(h ttps://zhuanlan.zhihu.com/p/87398682)
, c% `% Q8 w. F# a% a( {% z% v. w1 V) ?, z" U

* p% n4 ?' @$ _  K! |但我使用的laker找不到能設定netlist export的地方
- L. R( Q' h2 [+ @0 w4 Ght tps://imgur.com/jzWvgoV- C0 f/ g2 j! P8 O% F) L
* T9 p! i- e" b) [+ k0 p/ A
請問各位先進我該如何處理這個問題?6 U, W* h3 ?  F: R- I1 Z9 s6 p
1 o* f9 T( |2 y- F. z/ M( a
' x" Y- z- O) s1 k/ {

/ _7 C! c* d$ }4 ^3 v
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