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[問題求助] 請問 metal scheme 的意思 (ex: 5x2y2z??)

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1#
發表於 2010-4-27 11:21:44 | 只看該作者 回帖獎勵 |倒序瀏覽 |閱讀模式
請教 foundry fab 所謂 metal scheme x/y/z 意指??
- @" m6 {" r3 u6 Q2 s' t7 D一般所謂 1P5M 即一層poly (transistor gate, maybe WSix or salicide, maybe single poly or dual poly), 五層金屬層(M1~M5, M5 thick)6 R. [# Y2 w) s" X
X/Y/Z??
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發表於 2010-5-21 00:13:47 | 只看該作者
回復 2# vincent_p0593 & O8 s- |( q9 W$ R" d7 ^
  S, `, g" R# }" l5 H8 X
5x2y2z = 1p10M2 \5 d4 ]; I8 ^' J. `! |
/ I! J+ H6 S* S! I  i, z
台積的metal定義中 , F( Z3 g( C6 i8 |9 d
M1 為預設 寬度厚度不得更改 其他客戶可根據自己需要選擇要出幾層metal 光罩..但是最上層必須要厚的....2 ?' U; i- S4 g* N% c7 E
M2以上為 X 代表一倍厚度' U! p4 w8 h# t
M5 以上可用 Y (兩倍厚度) 或是 YZ ,或是 Z(四倍厚度)
# |. F* |" G5 d1 ?# G# U8 X6 @
! e1 t& V8 m/ X4 A' n4 u3 m/ r9 l不同的 metal 組合,有不同的 min pitch 以及對應的 RC 當然 DRC rule 也不同
+ F3 l! i" b! V* B! b# _: }/ O$ ?1 ^5 b; V# Y7 m  J; {2 }* t
1p10m5x2y2z 代表 m2~m6為 X, m7,m8 為Y ; m9,m10為Z 如果有RDL (flip chip package bump route) 則還多一層 AP (鋁)
- A- b3 J, r! `) n3 Y詳細的說明拿到台積的kits都有,客戶必須要透過正式管道才能拿到
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2#
 樓主| 發表於 2010-4-29 12:09:04 | 只看該作者
自解 : 昨天 t 朋友打電話來順便求解
5 d) Y  P+ X  q1 [" a( K2 Y5x2y2z 表示九層metal, M1~M5 用厚度1(薄), M6~M7用厚度2, M8~M9用厚度3(厚)0 [2 ?2 f1 R% ~* k1 m7 c+ y
每個process node各有其定義的厚度給x,y,z
) {3 ]' D8 C- @7 _) V- X2 l  B7 ^' r+ K0 j% M* h
目前的了解,...歡迎補充.
4#
 樓主| 發表於 2010-5-24 17:45:12 | 只看該作者
了解所述, 感謝!
" _6 F1 ~8 ^, q如果metal只有4層 這樣是否合規定 : 1p4m2x1y?
5 O5 ^/ U+ r/ nYZ 代表三倍厚度? or customize 2~4倍% R3 B+ P5 U6 N, O# L
Y, YZ, Z都可當top metal?
/ g( S. E. j, B
, Q' M' K" I! W% W; DThanks in advance.
5#
發表於 2010-6-1 22:53:54 | 只看該作者
要看哪一個process ~~ 有些有提供Y當top metal 的. 要把design rule翻出來看.
6#
發表於 2015-11-24 14:59:10 | 只看該作者
原來如此, 長知識了! 感謝!
7#
發表於 2019-3-9 17:16:35 | 只看該作者
Wow9 G$ b2 Y4 @2 j7 k* O* y
I think this is an important item for engineers work in foundry and IC Design house." Z, o$ m" X# V$ J- T, z" D" B3 g6 v1 M

7 [" [( E/ D/ H( u) x( t$ v" ?- m
8#
發表於 2020-6-23 23:19:02 | 只看該作者
解了我心中的疑惑 謝謝大大
$ p) f/ p# m+ ~0 w
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