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像是自己在設計電路
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& W% ?; q+ e/ E: `* L/ A( M然後趕在CIC下限前
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, }8 V# A3 }5 ~7 Y( }( D拼命的LAYOUT
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有時候,老師說要改規格
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" }) ~: u' b5 W( J# ?2 a1 \或是其他人說你的LAYOUT要考量一堆要件時
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那時候真的很吐血啊∼!∼!
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0 J+ G" w: ~* k+ J像我個人就覺得LAYOUT真的相當的累人
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尤其是再跑LVS的時候% K/ h# m5 v" \; @. b5 V+ ~; w
% H# w9 ^" O6 a, k) |* S+ f7 F除錯debug真的是要人命啊∼!! |
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