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[問題求助] 問一些altera的相關問題

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1#
發表於 2009-9-16 00:25:36 | 只看該作者 回帖獎勵 |倒序瀏覽 |閱讀模式
我手中有一塊altera cyclone II的版子
" E- Z7 b) j9 w  h7 q) g我知道使用Xilinx需設定腳位,使用ucf檔& {) G* M4 J5 v# u( B3 o
但是在使用altera的晶片時( T# X9 M! G) s2 W9 K+ G
看了一些資料
/ a0 Y& j. d5 q* @9 \0 `很像是在Assignments裡的pins設定腳位
8 B$ J/ H# @& F: b但是我設完clock之後
$ S( y- f; n5 q4 Z0 `. F( r卻出現錯誤:
1 N. R. a9 M2 t' f/ D8 aEditing location assignment is not sucessful.6 Z2 ~4 R# J: j. K( @6 P* p; a3 t
Non input node cannot be assigned to input pin.+ F6 d4 a9 Y& }$ x
是我設定錯誤,還是腳位不是這樣設的??
6 s  ]+ @: E: z3 e8 w' }有無資料可參考??
* _9 |! X& L: a% i我找不到有在說明設定腳位的= =
- f: n. V7 C$ Y* ^% C                                                                       
5 e  g. Y8 q6 n& R另外我想做一個mp3 decoder,而不用版子上的audio codec IC
5 @9 `5 n! v- ~9 u6 g而是直接寫verilog或VHDL在晶片上! r4 A: d! ^  n. M
再利用版子的上音效插孔接喇叭出來
) Y# W# }% B3 [4 w這樣子是可以的嗎??
- s0 p9 c9 t3 q5 d& k8 E但是硬體線路感覺是從cyclone晶片,經過audio codec IC
' r; h0 Y" o& R* ?再接音效插孔座
6 N' J! v2 S+ C8 u+ q所以不確定這樣可不可行$ Y; V! ]+ X5 Y/ Y" u
有人這樣子做過的嗎??
; L0 b! d% P& A) e" P如果可以的話,pins是用原來FPGA Pin No.就可以了嗎??
# j9 u1 F+ p2 ]; R' u7 t3 G- u我在網路上有找到VHDL source code- m* y- }8 }  A9 n+ J1 s
裡面有很多個檔案& l) w3 Q. E5 [: v. m# I
如果我要測試的話
7 h# \7 ]. R5 i要怎麼讓多個.vhd的檔案一起合成啊??
- A% n& K+ i% m0 U2 W8 z5 D  P非常感謝~
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2#
發表於 2009-10-9 17:10:13 | 只看該作者
http://www.fpga4fun.com/forum/vi ... 0fdec8d259da2ea79d2. q! o8 ^! K6 @/ X' Y

/ [6 e/ m( Q! S& Y6 mI had to do a couple of things to get it to work
6 Y2 X6 @7 v5 }8 I7 H1) needed a valid license file " K; [9 i+ s3 W" C& C7 i
2) Name of the Verilog HDL should be the same as the module specified in the actual code 6 e4 [0 i: D+ r) n, O# T: b
3) Compile first (Processing->Start Compilation to get the node list to populate in Pin Panner(in All Pins List)
3#
發表於 2009-10-20 21:23:56 | 只看該作者
原帖由 darren6ix 於 2009-9-16 12:25 AM 發表
2 e5 Y; {0 M, d& U' [; Y. w我手中有一塊altera cyclone II的版子$ r* P: ~6 j4 ^
我知道使用Xilinx需設定腳位,使用ucf檔
2 G- M4 ^( Y1 z. v但是在使用altera的晶片時( Y! @/ U; w0 x- c7 S
看了一些資料
3 ^( `. r5 H8 i6 x% L很像是在Assignments裡的pins設定腳位
; D6 v+ h1 p6 N. S$ T' ~4 W7 s但是我設完clock之後
0 D3 L/ C, D- z" X" Z卻出現錯誤:  x% r: }# X0 |9 s8 E
Editing loca ...
+ s, {% N) X5 G* G6 h$ g
Cyclone II版子是DE2平台嗎?" l( H( l' l$ z( E& ]+ ^
你可以上網Google一下那塊版子 去下載它的Spec.或User Manual 裡面有它FPGA腳位的資料 就會知道該怎麼接
8 o9 X8 c2 {: A5 H" m, j* C- m另外可以到Altera官網下載Quartus II和Nios II的Handbook或是看Altera提供的線上教學 就會基本Quartus和Nios II的操作  ^. P6 O! Q# N$ U5 [2 z

2 h7 e3 ]9 K9 T+ a( P  V# P可以# p& [' C6 K& O# g3 v8 w; R
不行 或許可以使用GPIO外接音源% e, x% J  g2 _2 u: [: S  G
Setting→File→Add 所有"相關"檔案放在同一個目錄(專案), y9 V8 z6 u; w, |3 T) t
VHDL檢查套件路徑路稱
7 S* V' E! M$ K' t) X$ ^Verilog檢查include
! [3 N- {- V) E! {6 [- C( j/ W; f
# Z/ h: w$ L4 I+ B8 N! V[ 本帖最後由 Kerick 於 2009-10-20 09:35 PM 編輯 ]
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