Chip123 科技應用創新平台

 找回密碼
 申請會員

QQ登錄

只需一步,快速開始

Login

用FB帳號登入

搜索
1 2 3 4
查看: 6859|回復: 3
打印 上一主題 下一主題

[問題求助] 關於Latch-up及Floor Plan 的問題

[複製鏈接]
跳轉到指定樓層
1#
發表於 2009-6-27 16:55:24 | 只看該作者 回帖獎勵 |倒序瀏覽 |閱讀模式
請各位大大們,幫忙小妹解決一下疑惑,恩感.3 V5 ^- R1 Q9 k% }3 }+ y: `' _* H
1.為何分別在pmos及nmos各圍了guard ring後,可降低Latch-up呢?
- {# e, k9 s" m+ q2.在混合電路中,要如何Floor Plan及注意些什麼呢?
分享到:  QQ好友和群QQ好友和群 QQ空間QQ空間 騰訊微博騰訊微博 騰訊朋友騰訊朋友
收藏收藏 分享分享 頂 踩 分享分享
2#
發表於 2009-6-30 18:32:51 | 只看該作者
1. 這樣可以增加放電的路徑
1 F5 M% F: I6 C: U6 i- R) H" r2. 依照頻寬的不同跟負載的不同而不同. \. B7 H" f0 g7 Q& l
在高負載的時候會增加noise並且回饋給power然後依此循環/ U9 l8 I- ^1 O! P; B# f
可以用增加小電容的方式穩定偏壓
1 g  f3 t8 J+ P2 J- h7 y5 z低頻寬可以放較多面積的vdd, vss , ground, 這有兩大類的作用
% }# A+ W- K; v2 T0 h9 r2 K; m一是增加電壓的穩定, 另外則是當做雜訊排除
) D. v) ?4 g( W# Q. I+ j$ Q% V高頻寬就相反, 類比信號的周圍最好不要有around ground, 會有漏電容, 影響頻寬, 雜訊過大(高頻的點太高)9 e% [' g! ~3 H. m  G% {) |7 f' @
數位的第跟類比的地要分開處理中間可以考慮用cmos或mos來連接, 一方面可以控制電流的流向, 使兩者信號不至於回流6 }$ H! H! w" D& n7 N4 Z# v- {
壓降也小, 總而言之在低頻寬的類比電路不同於高頻寬的類比電路, 很多觀念有時候是相反的

評分

參與人數 2Chipcoin +3 +10 收起 理由
Helena67 + 10 分享是成長動能,懂得分享回饋是無限的~
frank822 + 3 good response

查看全部評分

3#
發表於 2009-7-2 16:02:46 | 只看該作者

latch up 本质上是pnpn ,解决办法主要有2个

latch up 本质上是pnpn ,解决办法主要有2个,减小压降和减小寄生三极管的增益,你画下剖面图,就可以明白在pmos及nmos各圍了guard ring後的意义了。
4#
發表於 2009-7-11 11:25:51 | 只看該作者
加Guard ring 是避免漏電流使得電路導通而照成latch-up
您需要登錄後才可以回帖 登錄 | 申請會員

本版積分規則

首頁|手機版|Chip123 科技應用創新平台 |新契機國際商機整合股份有限公司

GMT+8, 2024-12-25 09:54 AM , Processed in 0.160009 second(s), 23 queries .

Powered by Discuz! X3.2

© 2001-2013 Comsenz Inc.

快速回復 返回頂部 返回列表