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Chip123 科技應用創新平台»論壇 › Chip1 -- 基礎元件 › FPGA/CPLD/ASIC討論區 › 關於FPGA Rount SSTL I/O and DDR問題
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[問題求助] 關於FPGA Rount SSTL I/O and DDR問題

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1#
發表於 2008-11-26 00:53:22 | 只看該作者 回帖獎勵 |倒序瀏覽 |閱讀模式
各位先進前輩: X7 T. q/ U2 C- v' o* ?+ _+ O
小的最近要將設計好的DDR Controller
7 U; x, r; f& y# B1 t放於Xilinx V5 FPGA內做P&R( I- Y* s& H: ~$ f) ~# _1 e
選用SSTL2 I/O,但是合成完後, b. j1 v0 k9 Q  A: k% w
電路都不會動( U( O1 E; r, x5 S2 H8 {' l. y$ }* u
不知道FPGA對DDR的連接上0 @* ^& y! Q% j- C7 Z' v
小弟有什麼沒注意到的
5 E0 e( T4 b3 t% y4 q造成電路不動作- I! Y  K: d. G* d
另外,不知大大們知不知道DDR的動作原理
- R+ `4 K$ r1 W+ Z; I可否解說一下
* C1 S) N+ ^* k! k+ u9 @感激不盡~~
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2#
發表於 2008-12-15 16:30:19 | 只看該作者
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