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[問題求助] 關於RING OSCILLATOR的問題~

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1#
發表於 2008-8-20 23:32:56 | 只看該作者 回帖獎勵 |倒序瀏覽 |閱讀模式
各位前輩~& D( Z0 \9 I+ H
- G9 d2 N  P) Y
我想請問一下關於這個RING OSCILLATOR的問題~7 r/ F9 S: b$ I( u' x! g
7 t9 ~4 z1 r6 v. V, x- w3 l
如附檔~0 p1 x5 ~- x8 L0 O# j/ v

- R- U' K( S" Z8 N; Y. W; x7 {+ B因為目前不想動這個架構,想透過調SIZE的方法來使得對VDD的靈敏度會最小~. l! O4 c4 K( m
# R. k. N; U4 z: \9 {% ^7 h
我目前調整是由調小中間INV的SIZE來達到,對VDD的靈敏度是有變小,不過卻怪怪的...
, B* g; R2 w$ E4 u' b% i: Y
8 H9 ]( c' ?6 b- m/ O9 C我RUN如下/ v/ Y( e* W1 }- T
VDD
' \) Y. |0 T: T( a3.6V 8.4M4 X- U' R3 }( [" V# Y4 s
3.4V 8.8M
' w' ?) k, K' B9 p3.2V 8.5M
8 h  ^9 k6 U, |6 }- y3.0V 8MHz1 @! `$ ~, m3 b1 G
2.6V 7.5M
# P' a  E, Y4 \. J2.4V 8.2M
1 T0 \2 _' |) o( R1 m" i- m, \
  @- F/ Q7 a" l) Z$ M) \; }正常不是VDD由大而小,頻率不是要減小嗎?(我認為)* s2 t/ T6 k  J

" ~( A0 ^* J( N. P5 m9 i2 j0 D我的這個想法正確嗎?1 {) E' j4 n$ u3 j; j
$ n  H6 `& b  K$ J% `# f) u
還是可以從哪個方向來思考呢?; O+ K5 P/ m6 w4 H
% n, I7 ]7 j2 b! _9 q2 z" s7 x# q
VDD對這個電路的影響是如何呢?有公式可以推導嗎?
+ \; I" B& g0 q" }+ K. j
" q4 }: E+ k  b- S* P, `; O) z) t/ s# N) C  _
請前輩們幫我看看~# g6 V5 E" i, }

5 c% Y) A( b' f3 B6 k謝謝

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2#
發表於 2008-8-25 22:07:49 | 只看該作者
你的模擬結果,頻率會不規律變化,感覺上有點奇怪。你要不要先確定一下,跑transient 模擬時輸出的頻率是否穩定了。5 E! S) ^( f4 E  K2 \$ x' D0 W

3 m& h' [) v0 Q2 y% m9 y一般來說由於VDD增加會使得delay cell PMOS的VDS上升,由於channel length modulation的影響,delay cell 充電的速度變快,7 l/ S; }, |) l! |
這也使得VCO震盪頻率會增加。
3#
 樓主| 發表於 2008-8-29 08:23:48 | 只看該作者
謝謝你的回答~
$ V8 u% X: H3 {" U( b/ w
3 a$ R) e/ {8 ?6 w# M# x我的頻率是不穩定的,就算.tran加大到100us也是一樣,freq並不會隨vdd增加而增加,且我還有一個疑問,就是ring oscillator在穩定時,真的每一cycle的頻率都會相等嗎?還是會有誤差,我的模擬結果,會有0.2%左右的誤差...
' b+ ?0 v# L9 m' \這樣有問題嗎?) m# U$ `7 R0 T, N! [1 v) ?- q

- H4 l/ G% g, m3 G- I/ E& L; }請前輩們在幫我看看...謝謝
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