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商周出版一本書: π型人:職場必勝成功術,,# {: E- D7 K8 ?0 [1 f# _! F- v
裡面提到「「π型人」的方法,讓你在最短時間內,選擇適合自己的第二專長,並與第一專長融合,發揮一加一大於二的威力,帶你安然度過景氣寒冬,成功迎接春天的到來。」
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在IC Layout世界裡, 小弟的解釋為:
' _$ v! z0 K2 i1 u7 GIC Layout工程師,除了提升本身IC LAYOUT的技能外,(平常多閱讀國外期刊,美國佈局專利或進修等..)# j7 Q5 p7 z4 W7 I- m5 J% b
另外再學習和本身工作的前、後,也就是上下游相關的知識.
5 L/ N' X( M# ~/ {5 T% e, B* i例如:IC設計和 晶圓製程或 CP測試1 Z/ ~6 G. w( {1 J
! r: t5 Z$ E3 R$ P' z+ u(??? 有人一定會問我,IC LAYOUT 學IC設計和測試做啥?) / f+ G: c$ ^. a% b8 }, c
隨著製程演進, IC Layout在舊製程不存在的問題, 在前瞻製程未必不會碰到,4 H" ^# _9 }, q5 a% h
; h8 U' L5 H2 j& ^4 I7 _學習IC設計並不是要超越IC Designer,而是為了能更清楚的溝通電路設計理念,
5 Y" _4 S+ z7 |6 t6 O7 M9 e' `/ R. f學習晶圓製程或CP(Wafer sort)也不是要成為製程或測試工程師,,
( R; \) C8 B2 C. k而是要了解自己的佈局在台積電裡面會怎麼跑, I/O PAD的擺放對CP(Wafer Sort)測試結果有沒有影響,或是可以最佳化
& j& U* b' a( \( u當然公司或Fab一定會有舊的Rule可以依循, 但是Rule為什麼要這麼定通常了解不深(因為太忙了..沒空想那個)
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* ?) @. R" j. N3 Z; R所以試著了解上下游合作的工程師在做什麼,, 辛苦一陣子,, h% s* m% h$ j: V! ?1 C
必然可以脫離 「像是在 做工ㄉ感覺得,, 」2 r) h# ~) t {' T% ^" z9 r" B
9 I1 ?% c A- M) I) `% H+ i共勉之~ |
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